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Xilinx-ISE 的查询结果
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VHDL/FPGA/Verilog 用与生成ISE的IP核的COE文件
用与生成ISE的IP核的COE文件，一些具体的参数要自己设置一下！
VHDL/FPGA/Verilog 这是xilinx公司的uart源代码
这是xilinx公司的uart源代码，希望对需要的朋友有所帮助
VHDL/FPGA/Verilog 用MATLAB里的XILINX BLOCK, 支持FPGA算法, 实现开平方, 并且取整.当计算停止时, VALID为高电瓶.
用MATLAB里的XILINX BLOCK, 支持FPGA算法, 实现开平方, 并且取整.当计算停止时, VALID为高电瓶.