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Xilinx-ISE 的查询结果
仿真技术 如何仿真IP核(建立modelsim仿真库完整解析)
IP核生成文件：（Xilinx/Altera 同）
IP核生成器生成 ip 后有两个文件对我们比较有用，假设生成了一个 asyn_fifo 的核，则asyn_fifo.veo 给出了例化该核方式（或者在 Edit－》Language Template-》COREGEN 中找到verilog/VHDL 的例化方式）。asyn_fifo.v 是该核的行为模型，主要调用了 xilinx 行为模型库的模块 ...
VHDL/FPGA/Verilog Xilinx Sdram控制器VHDL源代码
Xilinx Sdram控制器VHDL源代码
电子书籍 ise破解MODELSIM SE V5.5D.zip
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单片机开发 51的VERILOG代码！适用于Xilinx的FPGA
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嵌入式/单片机编程 xilinx virtex architecture
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嵌入式/单片机编程 xilinx virtex floorprint
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电子书籍 xilinx完整的教程
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单片机开发 Interface 8051 to Coolrunner CPLD(Xilinx App)
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VHDL/FPGA/Verilog xilinx的串口仿真程序
xilinx的串口仿真程序
VHDL/FPGA/Verilog Xilinx公司网站下的SDRAM Controller的参考设计
Xilinx公司网站下的SDRAM Controller的参考设计，经过验证