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VHDL SDRAM 的查询结果
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软件设计/软件工程 关于FPGA的一些常识及含IP核的VHDL设计源代码。
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软件设计/软件工程 VHDL中IP核之参数化触发器中文使用介绍
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软件设计/软件工程 VHDL中IP核之参数化加减法器中文使用介绍
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软件设计/软件工程 VHDL中LPM（参数化）库中文使用介绍
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电子书籍 《Digital Logic And Microprocessor Design With VHDL》
《Digital Logic And Microprocessor Design With VHDL》，CPU设计经典参考书
VHDL/FPGA/Verilog vhdl波形发生程序.实现4种常见波形正弦、三角、锯齿、方波（A、B）的频率、幅度可控输出（方波 A的占空比也是可控的）
vhdl波形发生程序.实现4种常见波形正弦、三角、锯齿、方波（A、B）的频率、幅度可控输出（方波
A的占空比也是可控的），可以存储任意波形特征数据并能重现该波形，还可完成
各种波形的线形叠加输出。
VHDL/FPGA/Verilog 三十个vhdl源码
三十个vhdl源码，对于刚开始学习vhdl的很有帮助，可以帮助理解数字电路
VHDL/FPGA/Verilog ddr_sdram控制器的vhdl代码,里面的地址和数据长度可配置,能满足不同用户的需要.
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VHDL/FPGA/Verilog sdram的行为级模拟模块,可以模拟一个sdram,用于仿真对sdram的控制.
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VHDL/FPGA/Verilog crack for ModelSim, a Verilog, VHDL and mixed VHDL / Verilog CAD simulator for FPGA, board and IC de
crack for ModelSim, a Verilog, VHDL and mixed VHDL / Verilog CAD simulator for FPGA, board and IC design.