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VHDL/FPGA/Verilog 用VHDL语言在CPLD上实现串行通信

用VHDL语言在CPLD上实现串行通信

https://www.eeworm.com/dl/663/129010.html

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VHDL/FPGA/Verilog FFT变换的IP核的源代码 VHDL~

FFT变换的IP核的源代码 VHDL~

https://www.eeworm.com/dl/663/129013.html

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VHDL/FPGA/Verilog VHDL语言按VGA接口标准把数字图像信号转换成标准VGA格式。适合做学习试验

VHDL语言按VGA接口标准把数字图像信号转换成标准VGA格式。适合做学习试验

https://www.eeworm.com/dl/663/129145.html

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VHDL/FPGA/Verilog VHDL开发的计数器。源程序不复杂

VHDL开发的计数器。源程序不复杂，应该都能看懂。最重要的注意：是时序问题

https://www.eeworm.com/dl/663/129570.html

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微处理器开发  CPU:S3C44B0X FLASH:HY29LV160BT 2M SDRAM:HY57V641620 8M 2 COM USB1.1 PDIUSBD12 NET RTL8019AS JTAG 14P

CPU:S3C44B0X FLASH:HY29LV160BT 2M SDRAM:HY57V641620 8M 2 COM USB1.1 PDIUSBD12 NET RTL8019AS JTAG 14PIN LCD 接口 4 KEY 3 LED 峰鸣器时钟电池

https://www.eeworm.com/dl/655/129595.html

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VHDL/FPGA/Verilog 用VHDL语言来实现一个电子时钟

用VHDL语言来实现一个电子时钟，可以调时间。小时，分，秒。可以下载到实验箱来运行验证。

https://www.eeworm.com/dl/663/129810.html

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VHDL/FPGA/Verilog RS232数据发送器,适合于VHDL的初学者参考

RS232数据发送器,适合于VHDL的初学者参考

https://www.eeworm.com/dl/663/129830.html

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VHDL/FPGA/Verilog 这是一个用vhdl编的多功能电子秒表

这是一个用vhdl编的多功能电子秒表，可以记录几个人的时间，并且可以在跑秒的时候查看记录。。〔原创〕

https://www.eeworm.com/dl/663/129942.html

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VHDL/FPGA/Verilog 大名鼎鼎的Synopsys公司出的8051IP Core VHDL语言编写

大名鼎鼎的Synopsys公司出的8051IP Core VHDL语言编写，能被keilC51支持

https://www.eeworm.com/dl/663/130913.html

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VHDL/FPGA/Verilog 这个是vhdl的彩灯实例程序

这个是vhdl的彩灯实例程序，里面涵盖了48种的彩灯变化，通过了maxplus的验证，并且在机上实验通过

https://www.eeworm.com/dl/663/131314.html

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