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软件设计/软件工程  VHDL中IP核之参数化加减法器中文使用介绍

VHDL中IP核之参数化加减法器中文使用介绍

https://www.eeworm.com/dl/684/172851.html

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软件设计/软件工程  VHDL中LPM（参数化）库中文使用介绍

VHDL中LPM（参数化）库中文使用介绍

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电子书籍  《Digital Logic And Microprocessor Design With VHDL》

《Digital Logic And Microprocessor Design With VHDL》，CPU设计经典参考书

https://www.eeworm.com/dl/cadence/ebook/173052.html

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VHDL/FPGA/Verilog vhdl波形发生程序.实现4种常见波形正弦、三角、锯齿、方波（A、B）的频率、幅度可控输出（方波 A的占空比也是可控的）

vhdl波形发生程序.实现4种常见波形正弦、三角、锯齿、方波（A、B）的频率、幅度可控输出（方波 A的占空比也是可控的），可以存储任意波形特征数据并能重现该波形，还可完成各种波形的线形叠加输出。

https://www.eeworm.com/dl/663/173668.html

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VHDL/FPGA/Verilog 三十个vhdl源码

三十个vhdl源码，对于刚开始学习vhdl的很有帮助，可以帮助理解数字电路

https://www.eeworm.com/dl/663/173672.html

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VHDL/FPGA/Verilog ddr_sdram控制器的vhdl代码,里面的地址和数据长度可配置,能满足不同用户的需要.

ddr_sdram控制器的vhdl代码,里面的地址和数据长度可配置,能满足不同用户的需要.

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VHDL/FPGA/Verilog crack for ModelSim, a Verilog, VHDL and mixed VHDL / Verilog CAD simulator for FPGA, board and IC de

crack for ModelSim, a Verilog, VHDL and mixed VHDL / Verilog CAD simulator for FPGA, board and IC design.

https://www.eeworm.com/dl/663/173848.html

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软件设计/软件工程  数字系统与VHDL程序设计语言[PPT教程]

数字系统与VHDL程序设计语言[PPT教程] ，非常有用．

https://www.eeworm.com/dl/684/173865.html

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VHDL/FPGA/Verilog system c 是在C环境下的硬件描述语言,比VHDL 等语言具有更强的抽象能力,内有system C的开发支持库和一些VC下的开发例程

system c 是在C环境下的硬件描述语言,比VHDL 等语言具有更强的抽象能力,内有system C的开发支持库和一些VC下的开发例程

https://www.eeworm.com/dl/663/174206.html

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VHDL/FPGA/Verilog Synthesizable model of Atmel ATmega103 microcontroller. (VHDL IP)

Synthesizable model of Atmel ATmega103 microcontroller. (VHDL IP)

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