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VHDL/FPGA/Verilog vhdl的学习资料

vhdl的学习资料，教程，一起进步，共勉

https://www.eeworm.com/dl/663/159869.html

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VHDL/FPGA/Verilog 这是一个曼彻斯特编解码的VHDL源代码

这是一个曼彻斯特编解码的VHDL源代码，非常好，值得一看。

https://www.eeworm.com/dl/663/159929.html

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VHDL/FPGA/Verilog 这是PCI 仲裁机制的VHDL源码

这是PCI 仲裁机制的VHDL源码，它实现了PCI仲裁机制。

https://www.eeworm.com/dl/663/159932.html

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加密解密  rijndael算法的一个vhdl语言编写的程序,可供学习者参考交流

rijndael算法的一个vhdl语言编写的程序,可供学习者参考交流

https://www.eeworm.com/dl/519/160032.html

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数学计算  这是用VHDL语言(硬件描述语言)写的一个二维 8*8块的离散余弦变换(DCT)以及反变换(IDCT).全同步设计,低门数.可以用于多媒体及打印应用领域.

这是用VHDL语言(硬件描述语言)写的一个二维 8*8块的离散余弦变换(DCT)以及反变换(IDCT).全同步设计,低门数.可以用于多媒体及打印应用领域.

https://www.eeworm.com/dl/641/160075.html

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数学计算  8-1024可变点数FFT/IFFT变换,VHDL语言设计, 仿真通过,可以很容易综合.

8-1024可变点数FFT/IFFT变换,VHDL语言设计, 仿真通过,可以很容易综合.

https://www.eeworm.com/dl/641/160076.html

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VHDL/FPGA/Verilog VHDL编写的PCI代码,PCI2.2兼容,Xillinx Virtex与Spantan II 优化,33M主频,32位宽度,全目标功能等.

VHDL编写的PCI代码,PCI2.2兼容,Xillinx Virtex与Spantan II 优化,33M主频,32位宽度,全目标功能等.

https://www.eeworm.com/dl/663/160079.html

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VHDL/FPGA/Verilog VHDL语言编写的中断模块,是个一般性的设计,可以很容易修改到你自己的设计中去.

VHDL语言编写的中断模块,是个一般性的设计,可以很容易修改到你自己的设计中去.

https://www.eeworm.com/dl/663/160081.html

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VHDL/FPGA/Verilog FFT的VHDL源代码的实现与仿真结果

FFT的VHDL源代码的实现与仿真结果，经过FPGA源型机验证，已通过

https://www.eeworm.com/dl/663/160176.html

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VHDL/FPGA/Verilog implemention of ssran in VHDL

implemention of ssran in VHDL

https://www.eeworm.com/dl/663/160185.html

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