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VHDL模块 的查询结果
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VHDL/FPGA/Verilog 基于vhdl的6进制计数器模块
基于vhdl的6进制计数器模块，实现0-5计数
VHDL/FPGA/Verilog 基于vhdl的10进制计数器模块
基于vhdl的10进制计数器模块，实现0-9计数
VHDL/FPGA/Verilog 用vhdl语言编写的MCU8051模块
用vhdl语言编写的MCU8051模块，结构清晰，十分有用
单片机开发 简易数字频率计利用复杂可编程逻辑器件FPGA,VHDL编程将所有功能模块集成在一块芯片上。功能模块包括时基脉冲发生器、计数器、数据锁存器和显示电路4部分。设计时先分别设计各功能模块
简易数字频率计利用复杂可编程逻辑器件FPGA,VHDL编程将所有功能模块集成在一块芯片上。功能模块包括时基脉冲发生器、计数器、数据锁存器和显示电路4部分。设计时先分别设计各功能模块，并调试得到正确仿真结果，然后将各个功能模块组合起来。最后作整体仿真、下载，得到实物。由于采用纯数字硬件设计制作，稳定性、可靠性远 ...
VHDL/FPGA/Verilog HDLC通信模块发送接收模块VHDL源码
HDLC通信模块发送接收模块VHDL源码
VHDL/FPGA/Verilog A/D采样控制模块设计 A/D采样控制模块负责控制外部ADC0809芯片多路模拟输入量的选通以及实现对A/D采样过程的合理控制。此部分的设计根据《EDA技术与VHDL》P211——P212的例8
A/D采样控制模块设计
A/D采样控制模块负责控制外部ADC0809芯片多路模拟输入量的选通以及实现对A/D采样过程的合理控制。此部分的设计根据《EDA技术与VHDL》P211——P212的例8-2编写，所不同的是这里将书中“ADDA<=1”的赋值语句改为“ADDA <=EN”，EN是所设置的输入按键用来控制INO与IN1间的通道选择。 ...
VHDL/FPGA/Verilog VHDL设计的高速图像采集模块源码
VHDL设计的高速图像采集模块源码，离散余弦变换，图像压缩与编码源码
VHDL/FPGA/Verilog 用VHDL实现数字频率计,1. 时基产生与测频时序控制电路模块2. 待测信号脉冲计数电路模块3.锁存与译码显示控制电路模块4.顶层电路模块.
用VHDL实现数字频率计,1. 时基产生与测频时序控制电路模块2. 待测信号脉冲计数电路模块3.锁存与译码显示控制电路模块4.顶层电路模块.
VHDL/FPGA/Verilog VHDL 源码模块
VHDL 源码模块，可以实现最经典原PWM，可以用于电源，电机的控制
VHDL/FPGA/Verilog 基于VHDL的定时计数芯片的设计 通过模块化
基于VHDL的定时计数芯片的设计
通过模块化，状态图设计实现定时芯片