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VHDL/FPGA/Verilog 计费器设计中速度控制模块、里程计数模块、计费计数模块vhdl源代码
计费器设计中速度控制模块、里程计数模块、计费计数模块vhdl源代码
VHDL/FPGA/Verilog 本VHDL源代码由顶层模块、测频模块、驱动模块、计算模块、LCD显示模块、复位模块组成
本VHDL源代码由顶层模块、测频模块、驱动模块、计算模块、LCD显示模块、复位模块组成，能精确检测从1--100M频率，误差极小且恒定。
VHDL/FPGA/Verilog 本程序是用VHDL语言实现电子密码锁功能,整个系统分为三大模块,一为控制模块,二为键盘显示模块,三为处理模块
本程序是用VHDL语言实现电子密码锁功能,整个系统分为三大模块,一为控制模块,二为键盘显示模块,三为处理模块
VHDL/FPGA/Verilog 采用vhdl语言编写的16x2液晶显示模块的驱动程序。在quartus中编译完成
采用vhdl语言编写的16x2液晶显示模块的驱动程序。在quartus中编译完成，可直接运行
嵌入式/单片机编程 基于fpga和sopc的用VHDL语言编写的EDA的PS/2鼠标键盘控制模块
基于fpga和sopc的用VHDL语言编写的EDA的PS/2鼠标键盘控制模块
嵌入式/单片机编程 基于fpga和sopc的用VHDL语言编写的EDA的PS/2鼠标与VGA控制模块
基于fpga和sopc的用VHDL语言编写的EDA的PS/2鼠标与VGA控制模块
嵌入式/单片机编程 基于fpga和sopc的用VHDL语言编写的EDA的USB控制模块程序
基于fpga和sopc的用VHDL语言编写的EDA的USB控制模块程序
VHDL/FPGA/Verilog VHDL实现的奇偶校验功能模块和一个外设配置寄存器的设计实例。
VHDL实现的奇偶校验功能模块和一个外设配置寄存器的设计实例。
书籍源码 运用vhdl语言编程,是数字逻辑中的电子钟!各模块及源代码都有,适合电信同学使用!
运用vhdl语言编程,是数字逻辑中的电子钟!各模块及源代码都有,适合电信同学使用!
通讯/手机编程 vhdl实现miniUART代码 分模块设计和状态机设计,内核超级小
vhdl实现miniUART代码 分模块设计和状态机设计,内核超级小