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VERILOG-HDL 的查询结果
可编程逻辑 Guide to HDL Coding Styles for Synthesis
这篇文章讨论了不同HDL代码的编写方式，对综合结果的影响。阅读本文对深入了解综合工具和提高HDL的编写水平有不少帮助，原文时针对Synopsys的综合软件论述的，但对所有综合软件，都有普遍的借鉴意义
可编程逻辑 Virtex-6 的HDL设计指南
针对Virtex-6 给出了HDL设计指南，其中，赛灵思为每个设计元素给出了四个设计方案元素，并给出了Xilinx认为是最适合你的解决方案。这4个方案包括：实例，推理，CORE Generator或者其他Wizards，宏支持.
加密解密 DES 加密算法的VHDL和VERILOG 源程序及其TESTBENCH。
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VHDL/FPGA/Verilog 本文为verilog的源代码
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文章/文档 Verilog编码与综合中的非阻塞性赋值
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嵌入式/单片机编程 8位RISC CPU的VERILOG编程 SOURCECODE
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嵌入式/单片机编程 Verilog DHL教程
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嵌入式/单片机编程 sdram的verilog的源码实现
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嵌入式/单片机编程 PCI接口的Verilog源代码
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文章/文档 有关VERILOG的比较精辟的介绍
有关VERILOG的比较精辟的介绍，不容错过！