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VERILOG-HDL 的查询结果
VHDL/FPGA/Verilog Verilog HDL程序
Verilog HDL程序，对硬件开发有兴趣或需要的朋友赶快down下来
电子书籍 Lattice公司的A Verilog HDL Test Bench Primer应用手册
Lattice公司的A Verilog HDL Test Bench Primer应用手册
VHDL/FPGA/Verilog 硬件uart源程序verilog HDL
硬件uart源程序verilog HDL，即相关文档
VHDL/FPGA/Verilog Verilog HDL 程序 双路脉冲发生器的代码 包含了键盘控制
Verilog HDL 程序
双路脉冲发生器的代码
包含了键盘控制，LED显示，脉冲发生，脉冲频率测量模块
是我自己写得，希望能对你有帮助，有问题可以mail：shaojunwu1@163.com
VHDL/FPGA/Verilog 用cpld实现曼彻斯特编码 用verilog HDL进行曼彻斯特编码
用cpld实现曼彻斯特编码
用verilog HDL进行曼彻斯特编码，用于通信中
VHDL/FPGA/Verilog 异步FIFO控制器的设计 主要用于异步先进先出控制器的设计。 所用语言Verilog HDL.
异步FIFO控制器的设计
主要用于异步先进先出控制器的设计。
所用语言Verilog HDL.
VHDL/FPGA/Verilog D触发器的设计 主要用在时序电路中。 所用语言为Verilog HDL.
D触发器的设计
主要用在时序电路中。
所用语言为Verilog HDL.
VHDL/FPGA/Verilog 用一位全加器组成四位全加器. 所用语言是Verilog HDL. 主要用在加法器的设计中。
用一位全加器组成四位全加器.
所用语言是Verilog HDL.
主要用在加法器的设计中。
VHDL/FPGA/Verilog 指令译码电路的设计。 主要用在数字电路的设计中。 所用语言为Verilog HDL.
指令译码电路的设计。
主要用在数字电路的设计中。
所用语言为Verilog HDL.
VHDL/FPGA/Verilog 11,13,16位超前进位加法器的Verilog HDL源代码。
11,13,16位超前进位加法器的Verilog HDL源代码。