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其他 VHDL 实现的SPI接口
VHDL 实现的SPI接口，在Altera EMP7128 上应用过
VHDL/FPGA/Verilog 文章论述如何将向modelsim中添加仿真库
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VHDL/FPGA/Verilog logic lock 的vhdl源码
logic lock 的vhdl源码，altera平台适用。
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一首VHDL自动音乐发生器程序，在Altera EDA软件下测试通过
嵌入式/单片机编程 利用带有I2C总线接口的日历时钟芯片DS1337
利用带有I2C总线接口的日历时钟芯片DS1337，在NIOS II嵌入式系统平台上实现一个实时时钟，并可在显示器上显示出预置的时分秒。硬件平台为Altera的Cyclone II版Nios II开发环境
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NIOSII的7个c语言源码，是7个例子，分别在niosII IDE环境下实现，不同的功能。是基于altera的标准c，目前资源较少。
VHDL/FPGA/Verilog 一个使用VHDL设计的具有强大功能的32位CPU
一个使用VHDL设计的具有强大功能的32位CPU，这个文件包含了在Altera公司的ep1c20 FPGA的位码文件和配置文件，可以直接下载使用！
其他 如何给时钟倍频或者分频
如何给时钟倍频或者分频，以及altera提供的IP核使用方法
VHDL/FPGA/Verilog 2级流水线实现的8位全加器的VHDL代码
2级流水线实现的8位全加器的VHDL代码，适用于altera系列的FPGA/CPLD