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找到约 513 项符合 SDRAM 的查询结果

嵌入式综合 基于CPCI总线的一体化数据处理中心的研究

为了满足工业控制系统多功能和数据处理能力的需求,设计了基于CPCI总线的一体化数据处理中心。系统以FPGA芯片为硬件控制核心,利用硬件描述语言Verilog进行编程,采用自顶向下和模块化的设计方法,实现了在同一嵌入式产品上集成光纤通信、A/D、D/A、CPCI总线、SDRAM存储等功能,实现了系统的一体化、小型化。实际应用表明本 ...
https://www.eeworm.com/dl/566/34974.html
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嵌入式综合 基于ARM11处理器的嵌入式视频处理终端设计与实现

基于ARM11的嵌入式视频处理终端设计 在研究了基于ARMl 1体系结构的Samsung$3C6410处理器的基 础上,给出了多格式视频编解码的使用方法和Windows CE下中断流 驱动的设计方法,为Windows CE操作系统下的图像采集和视频处理 的复杂控制提供了软件实现的方法;并以该处理器为核心,加上外部 存储器和USB摄像头等接口电路 ...
https://www.eeworm.com/dl/566/35014.html
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嵌入式综合 最详细的NIOSII教程

  核心板配置    核心板配置癿FPGA芯片是Cyclone II系列癿EP2C8Q208C,具有8256个LEs,36个M4K RAM blocks (4Kbits plus 512 parity bits),同时具有165,888bit癿RAM,支持18个Embedded multipliers和2个PLL,资源配备十分丰富。实验证明,返款芯片在嵌入NIOS II软核将黑釐开収板癿所有外讴全部跑起来,仅占全 ...
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嵌入式综合 SmartARM9B92工控教学开发平台简介

SmartARM9B92 是由广州致远电子有限公司完全按照工业级标准(EMC/EMI)设计开发的一款通用工控/教学开发平台,其核心控制器采用了TI 公司最新推出的LM3S9000 系列芯片。LM3S9000 在通用处理性能方面取得了最新突破,实现了连接性、存储器配置与高级运动控制的完美结合。SmartARM9B92 开发平台提供了丰富的接口:外部总线接 ...
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无线通信 GPON中ONU系统研究和GTC层接口设计

本文首先从无源光网络的原理出发,分析了目前几种PON技术,进行比较后指出了GPON的优势。然后阐述了GPON系统的结构、工作原理以及其协议规范,重点是TC层结构,描述了控制平面(C/M)和用户(U)平面协议栈。接下来介绍了ONU的分层功能模块,并依此提出了ONU的分层设计思想,将ONU端划分为物理媒介层(PMD)、传输汇聚层(GTC)及 ...
https://www.eeworm.com/dl/510/36527.html
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开关电源 RT9005/RT9005A/RT9005B datasheet pdf

The RT9005A/B is a dual-output Linear regulator for DDR-SDRAM VDDQ supply and termination voltage VTT supply.
https://www.eeworm.com/dl/520/36575.html
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可编程逻辑 基于FPGA的实时视频信号处理平台的设计

提出一种基于FPGA的实时视频信号处理平台的设计方法,该系统接收低帧率数字YCbCr 视频信号,对接收的视频信号进行格式和彩色空间转换、像素和,利用片外SDRAM存储器作为帧缓存且通过时序控制器进行帧率提高,最后通过VGA控制模块对图像信号进行像素放大并在VGA显示器上实时显示。整个设计使用Verilog HDL语言实现,采用Alte ...
https://www.eeworm.com/dl/kbcluoji/39646.html
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可编程逻辑 MIG生成的DDR2+SDRAM控制器

MIG生成的DDR2相关的代码
https://www.eeworm.com/dl/kbcluoji/39781.html
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可编程逻辑 基于FPGA的LVDS高速数据通信卡设计

基于FPGA、PCI9054、SDRAM和DDS设计了用于某遥测信号模拟源的专用板卡。PCI9054实现与上位机的数据交互,FPGA实现PCI本地接口转换、数据接收发送控制及DDS芯片的配置。通过WDM驱动程序设计及MFC交互界面设计,最终实现了10~200 Mbit·s-1的LVDS数据接收及10~50 Mbit·s-1任意速率的LVDS数据发送。 ...
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可编程逻辑 XAPP708 -133MHz PCI-X到128MB DDR小型DIMM存储器桥

  The Virtex-4 features, such as the programmable IDELAY and built-in FIFO support, simplifythe bridging of a high-speed, PCI-X core to large amounts of DDR-SDRAM memory. Onechallenge is meeting the PCI-X target initial latency specification. PCI-X Protocol Addendum tothe PCI Local Bus Spec ...
https://www.eeworm.com/dl/kbcluoji/40099.html
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