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RTL 的查询结果
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其他书籍 是一个用于soc的32bit risc核
是一个用于soc的32bit risc核，文件包括了核的rtl代码，文档、testbench码。
VHDL/FPGA/Verilog The xapp851.zip archive includes the following subdirectories. The specific contents of each subdi
The xapp851.zip archive includes the following subdirectories. The specific
contents of each subdirectory below:
\rtl - HDL design files
\sim - simulation files
\synth - Synthesis related files
\par - Place/Route related files
其他 nec 78F0413的例子程序,里面有LCD
nec 78F0413的例子程序,里面有LCD，RTL和PORT的操作，学NEC的朋友可以使用
其他 使用函数实现简单的八位处理器 软件开发环境：ISE 7.1i 仿真环境：ISE Simulator 1. 这个实例实现通过ISE Simulator工具实现一个可以进行两个八位操作数四
使用函数实现简单的八位处理器
软件开发环境：ISE 7.1i
仿真环境：ISE Simulator
1. 这个实例实现通过ISE Simulator工具实现一个可以进行两个八位操作数四种操作的简单处理器；
2. 工程在project文件夹中，双击mpc.ise文件打开工程；
3. 源文件在rtl文件夹中，mpc.v为设计文件，mpc_tb.tbw是仿真波形文件；
4. 打开工程 ...
VHDL/FPGA/Verilog 典型实例10.8 字符LCD接口的设计与实现 软件开发环境：ISE 7.1i 硬件开发环境：红色飓风II代－Xilinx版 1. 本实例控制开发板上面的LCD的显示； 2. 工程在pr
典型实例10.8 字符LCD接口的设计与实现
软件开发环境：ISE 7.1i
硬件开发环境：红色飓风II代－Xilinx版
1. 本实例控制开发板上面的LCD的显示；
2. 工程在\project文件夹里面
3. 源文件和管脚分配在\rtl文件夹里面
4. 下载文件在\download文件夹里面,.mcs为PROM模式下载文件,.bit为JTAG调试下载文件。 ...
VHDL/FPGA/Verilog 完整的等精度频率相位计
完整的等精度频率相位计，包含了项目文件、VHDL源代码、RTL电路图
VHDL/FPGA/Verilog 教你用各种方法实现分频
教你用各种方法实现分频，实现良好的时序。个你的RTL开发增加经验
VHDL/FPGA/Verilog 用VHDL语言描述的用锁存器
用VHDL语言描述的用锁存器，加法计数器，ROM存储器构成的RTL图
设计相关 MC8051IP核的FPGA实现
MC8051IP核的FPGA实现与应用；VHDL;MC8051IP核；RTL封装
可编程逻辑 CPLD_FPGA设计经验分享
在数字电路的设计中，时序设计是一个系统性能的主要标志，在高层次设计方法中，对时序控制的抽象度也相应提高，因此在设计中较难把握，但在理解RTL电路时序模型的基础上，采用合理的设计方法在设计复杂数字系统是行之有效的，通过许多设计实例证明采用这种方式可以使电路的后仿真通过率大大提高，并且系统的工作频率可以达 ...