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可编程逻辑  基于FPGA的RS码译码器的设计

介绍了符合CCSDS标准的RS（255，223）码译码器的硬件实现结构。译码器采用8位并行时域译码算法，主要包括了修正后的无逆BM迭代译码算法，钱搜索算法和Forney算法。采用了三级流水线结构实现，减小了译码器的时延，提高了译码的速率，使用了VHDL语言完成译码器的设计与实现。测试表明，该译码器性能优良，适用于高速通信。 ...

https://www.eeworm.com/dl/kbcluoji/39025.html

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测试测量  微电脑型RS-485显示电表（2448mm/4896mm）

微电脑型RS-485显示电表（24*48mm/48*96mm）特点： 5位数RS-485显示电表显示范围-19999-99999位數通訊协议Modbus RTU模式宽范围交直流兩用電源設計尺寸小,穩定性高主要规格：显示范围:-19999~99999 digit RS-485传输速度: 19200/9600/4800/2400 selective RS-485通讯位址: "01"-"FF" RS-485通讯协议: Modbus RTU mod ...

https://www.eeworm.com/dl/544/41698.html

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接口技术  具有载波检测功能的隔离RS-485电路

当RS-485用于多主通信的总线系统时，多个主机同时发送数据，将会导致数据冲突。为了避免冲突发生，介绍了一种RS-485电路，用简单硬件实现了总线状态的检测，大大降低了数据冲突概率。另外，为了避免总线上的干扰信号影响系统设备，通常需要实现总线与设备内部电路隔离，为此，文中提出了一种新的RS-485电路隔离方案。 ...

https://www.eeworm.com/dl/511/42330.html

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接口技术  基于SPI总线的RS-422接口电路设计

以SPI总线技术为基础，用微控制器S3C2450X和电平转换芯片MAX3088设计了一个RS-422接口电路，将SPI单端非平衡传输信号转换为RS-422差分信号。在保证SPI同步传输的高效性和高速性的同时，还增强了信号的抗干扰能力。主要使用9 个信号主机输入G从机输出C 主机输出从机输入串行时钟C 或外设片选或从机选择信号由从机在主机的 ...

https://www.eeworm.com/dl/511/42423.html

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