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C/C++语言编程  第14章源代码控制

当许多编程人员从事这项工作但又不使用源代码管理工具时，源代码管理几乎不可能进行。Visual SourceSafe是Visual Basic的企业版配备的一个工具，不过这个工具目的是为了保留一个内部应用版本，不向公众发布（应当说明的是，M i c r o s o f t并没有开发Visual SourceSafe，它是M i c r o s o f t公司买来的）。虽然Visual ...

https://www.eeworm.com/dl/503/37341.html

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开发工具  电路图、源代码

（电路图、源代码）

https://www.eeworm.com/dl/550/37796.html

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实用工具  电路图、源代码

（电路图、源代码）

https://www.eeworm.com/dl/551/38396.html

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可编程逻辑  Altera FPGA_CPLD设计（实例源代码）

Altera FPGA_CPLD设计（实例源代码）

https://www.eeworm.com/dl/kbcluoji/38639.html

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可编程逻辑  定制简单LED的IP核的设计源代码

定制简单LED的IP核的设计源代码

https://www.eeworm.com/dl/kbcluoji/39099.html

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可编程逻辑  自学ZedBoard：使用IP通过ARM PS访问FPGA（源代码）

　　这一节的目的是使用XPS为ARM PS 处理系统添加额外的IP。从IP Catalog 标签添加GPIO，并与ZedBoard板子上的8个LED灯相连。当系统建立完后，产生bitstream，并对外设进行测试。本资料为源代码，原文设计过程详见：【玩转赛灵思Zedboard开发板（4）：如何使用自带外设IP让ARM PS访问FPGA？】　　硬件平台：Digilent ...

https://www.eeworm.com/dl/kbcluoji/39119.html

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可编程逻辑  altera FPGA/CPLD高级篇(VHDL源代码)

      altera FPGA/CPLD高级篇(VHDL源代码)

https://www.eeworm.com/dl/kbcluoji/39262.html

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可编程逻辑  基于Quartus II FPGA/CPLD数字系统设计实例（VHDL源代码文件）

　　本资料是关于基于Quartus II FPGA/CPLD数字系统设计实例（VHDL源代码文件），需要的可以自己下载。

https://www.eeworm.com/dl/kbcluoji/39267.html

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可编程逻辑  Altera+FPGA_CPLD设计（实例源代码）

Altera+FPGA_CPLD设计（实例源代码）

https://www.eeworm.com/dl/kbcluoji/39825.html

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可编程逻辑  各种功能的计数器实例（VHDL源代码）

各种功能的计数器实例（VHDL源代码）:

https://www.eeworm.com/dl/kbcluoji/40396.html

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