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其他  时钟和复位模块的仿真程序设计

时钟和复位模块的仿真程序设计，用Modelsim仿真

https://www.eeworm.com/dl/534/298081.html

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VHDL/FPGA/Verilog I2c中通信的从机发送和接收信息的Verilog程序测试模块

I2c中通信的从机发送和接收信息的Verilog程序测试模块，用Modelsim仿真通过

https://www.eeworm.com/dl/663/298091.html

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VHDL/FPGA/Verilog 此代码实现不同图像颜色制式之间的相互转换

此代码实现不同图像颜色制式之间的相互转换，如XYZ<->RGB, 不同标准的RGB<->RGB 以及RGB<->YCbCr之间的转换，包内含有matlab仿真代码m文件、VHDL代码.v文件以及modelsim仿真的testbench文件，相信对大家有一定的帮助

https://www.eeworm.com/dl/663/300544.html

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matlab例程  分析了MATLAB/Simulink 中DSP Builder 模块库在FPGA 设计中优点

分析了MATLAB/Simulink 中DSP Builder 模块库在FPGA 设计中优点，然后结合FSK 信号的产生原理，给出了如何利用DSP Builder 模块库建立FSK 信号发生器模型，以及对FSK 信号发生器模型进行算法级仿真和生成VHDL 语言的方法，并在modelsim 中对FSK 信号发生器进行RTL 级仿真，最后介绍了在FPGA 芯片中实现FSK 信号发生器的设 ...

https://www.eeworm.com/dl/665/314983.html

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其他  骏龙提供的最新quartus8.0的license

骏龙提供的最新quartus8.0的license，包括Quartus II 8.0，NIOS II 8.0（在Quartus II的license里面），DSP Builde 8.0，ModelSim-Altera 6.1g (Quartus II 8.0)，新Quartus II的license支持远程桌面访问的功能。

https://www.eeworm.com/dl/534/322625.html

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VHDL/FPGA/Verilog 应用VHDL编写程序

应用VHDL编写程序，利用ModelSim仿真CPU

https://www.eeworm.com/dl/663/324197.html

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VHDL/FPGA/Verilog 这是基于verilog语言写的

这是基于verilog语言写的，是基于fpga的数字锁相环的设计，用modelsim打开

https://www.eeworm.com/dl/663/324454.html

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嵌入式/单片机编程  数字系统CAD 开发平台实验部分共有6 个实验

数字系统CAD 开发平台实验部分共有6 个实验，内容覆盖了ISE 的设计使用、片内逻辑分析仪ChipScope 的使用、设计仿真工具Modelsim 的使用、以及嵌入式系统设计工具EDK的使用等内容。在每个实验的说明中分别介绍它们的使用。包括：实验一、7 段数码管显示简单的时钟实验二、设计串口与计算机通信实验三、A/D 采样模块设 ...

https://www.eeworm.com/dl/647/329991.html

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通讯/手机编程  上传的是WIMAX系统中

上传的是WIMAX系统中，CTC译码算法的仿真程序，基于Modelsim

https://www.eeworm.com/dl/527/338256.html

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VHDL/FPGA/Verilog 本实验教程选用Xilinx公司的产品X9572

本实验教程选用Xilinx公司的产品X9572，与之配套的开发软件为ISE4.1i，可进行原理图的输入和VHDL硬件描述语言的输入，并且可利用Modelsim进行功能仿真和时序仿真。

https://www.eeworm.com/dl/663/342058.html

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