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模拟电子 宽带低EVM直接变频发射机

本电路为宽带直接变频发射机模拟部分的完整实施方案(模拟基带输入、RF输出)。通过使用锁相环(PLL)和宽带集成电压控制振荡器(VCO),本电路支持500 MHz至4.4 GHz范围内的RF频率。PLL中的LO执行谐波滤波,确保提供出色的正交精度。低噪声LDO确保电源管理方案对相位噪声和EVM没有不利影响。这种器件组合可以提供500 MHz至4.4 ...
https://www.eeworm.com/dl/571/20464.html
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模拟电子 实现UXGA解决方案的双通道AD9981设计准则

借助AD9981,利用一种双芯片“乒乓”配置可以实现超过110 MHz的像素时钟速率。双芯片解决方案与交替像素采样解决方案的不同之处在于,前者可以维持全速刷新率。双通道AD9981设计有多种实现方式。本应用笔记旨在让用户了解在实现这种配置时需要考虑的因素。相关变量包括布局和路由限制、时钟选择、图形控制要求 ...
https://www.eeworm.com/dl/571/20467.html
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模拟电子 实现UXGA解决方案的双通道AD9884A设计准则

借助AD9884A,利用一种双芯片“乒乓”配置可以实现超过140 MHz的像素时钟速率。双芯片解决方案与交替像素采样解决方案的不同之处在于,前者可以维持全速刷新率。双通道AD9884A设计有多种实现方式。本应用笔记旨在让用户了解在实现这种乒乓配置时需要考虑的因素。相关变量包括布局和路由限制、时钟选择、图形控 ...
https://www.eeworm.com/dl/571/20469.html
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模拟电子 一种基于gm_ID方法设计的可变增益放大器

提出了一种基于gm /ID方法设计的可变增益放大器。设计基于SMIC90nmCMOS工艺模型,可变增益放大器由一个固定增益级、两个可变增益级和一个增益控制器构成。固定增益级对输入信号预放大,以增加VGA最大增益。VGA的增益可变性由两个受增益控制器控制的可变增益级实现。运用gm /ID的综合设计方法,优化了任意工作范围内,基于gm ...
https://www.eeworm.com/dl/571/20482.html
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模拟电子 基于ADF4111的锁相环频率合成器设计

为得到性能优良、符合实际工程的锁相环频率合成器,提出了一种以ADI的仿真工具ADIsimPLL为基础,运用ADS(Advanced Design System 2009)软件的快速设计方法。采用此方法设计了频率输出为930~960 MHz的频率合成器。结果表明该频率合成器的锁定时间、相位噪声以及相位裕度等指标均达到了设计目标。 ...
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模拟电子 基于ADS高效率微波功率放大器设计

基于ADS软件,选取合适的静态直流工作点,采用负载牵引法得到LDMOS晶体管BLF7G22L130的输出和输入阻抗特性,并通过设计和优化得到最佳的共轭匹配网络,设计出高效率功率放大器。ADS设计仿真表明该功率放大器在中心频率2 160 MHz处的效率达到70%,稳定性好、增益平坦度小等优点。 ...
https://www.eeworm.com/dl/571/20592.html
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模拟电子 AD9880色彩空间转换器用户指南

AD9880中的色彩空间转换矩阵(CSC)是一个3 × 3矩阵,可提供矩阵中所有系数下的完全编程能力。每个系数均为12位宽,以保持信号完整性。CSC可在高达150 MHz的速度下运行,在60 Hz速率时支持1080 p。CSC支持“任意至任意”色彩空间,支持RGB、YUV、YCrCb等格式。 ...
https://www.eeworm.com/dl/571/20605.html
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模拟电子 基于第二代电流传输器的积分器设计

介绍了一种基于低压、宽带、轨对轨、自偏置CMOS第二代电流传输器(CCII)的电流模式积分器电路,能广泛应用于无线通讯、射频等高频模拟电路中。通过采用0.18 μm工艺参数,进行Hspice仿真,结果表明:电流传输器电压跟随的线性范围为-1.04~1.15 V,电流跟随的线性范围为-9.02~6.66 mA,iX/iZ的-3 dB带宽为1.6 GHz。输出 ...
https://www.eeworm.com/dl/571/20872.html
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模拟电子 一种X波段频率合成器的设计方案

  在非相参雷达测试系统中,频率合成技术是其中的关键技术.针对雷达测试系统的要求,介绍了一种用DDS激励PLL的X波段频率合成器的设计方案。文中给出了主要的硬件选择及具体电路设计,通过对该频率合成器的相位噪声和捕获时间的分析,及对样机性能的测试,结果表明该X波段频率合成器带宽为800 MHz、输出相位噪声优于-80 ...
https://www.eeworm.com/dl/571/20966.html
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模拟电子 带有增益提高技术的高速CMOS运算放大器设计

设计了一种用于高速ADC中的高速高增益的全差分CMOS运算放大器。主运放采用带开关电容共模反馈的折叠式共源共栅结构,利用增益提高和三支路电流基准技术实现一个可用于12~14 bit精度,100 MS/s采样频率的高速流水线(Pipelined)ADC的运放。设计基于SMIC 0.25 μm CMOS工艺,在Cadence环境下对电路进行Spectre仿真。仿真结 ...
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