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VHDL/FPGA/Verilog 《VDHL硬件描述语言与数字逻辑》 ——————电子工程师必备知识 西安电子科技大学出版社出版 第一章 数字系统硬件设计概述 第二章 VHDL语言程序的基本结构 第三章 VHDL语言的数据类
《VDHL硬件描述语言与数字逻辑》
——————电子工程师必备知识
西安电子科技大学出版社出版
第一章 数字系统硬件设计概述
第二章 VHDL语言程序的基本结构
第三章 VHDL语言的数据类型及运算操作符
第四章 VHDL语言构造体的描述方式
第五章 VHDL语言的主要描述语言
第六章 数值系统的状态模型
第七章 基本逻辑电路设计
第 ...
matlab例程 ％radon transform clear all ％ N=800 n=1:N fs=200 t=n/fs x1=exp(j*2*pi*(5*t+0.5*5*t.^2
％radon transform
clear all
％
N=800
n=1:N
fs=200
t=n/fs
x1=exp(j*2*pi*(5*t+0.5*5*t.^2))
x2=exp(j*2*pi*(5*t+0.5*15*t.^2))
x=x1+x2
％N=length(x)
％ ambifunb(x )
％*****************************************RAT
naf=ambifunb(x)
htl(abs(naf))
％ [wh,rho,theta]=htl(abs(naf))
colormap([0, ...
系统设计方案 介绍了一种采用硬件控制的自动数据采集系统的设计方法
介绍了一种采用硬件控制的自动数据采集系统的设计方法，包括数字系统自顶向下的设计思路、Verilog HDL对系统硬件的描述和状态机的设计以及MAX+PLUSII开发软件的仿真。设计结果表明：该采集系统具有很高的实用价值，极大地提高了系统的信号处理能力。 ...
Java编程 Finally: a hands-on, Java-centric workbook companion for the classic Design Patterns! Workbook appro
Finally: a hands-on, Java-centric workbook companion for the classic Design Patterns! Workbook approach deepens your understanding, builds your confidence, and strengthens your skills. Covers all five categories of design pattern intent: interfaces, responsibility, construction, operations, and exte ...
VHDL/FPGA/Verilog 16位A/D转换程序
16位A/D转换程序，使用MAX+PLUS2做的，用状态机做的，但不够完善，望大家见谅
行业发展研究 The task of clustering Web sessions is to group Web sessions based on similarity and consists of max
The task of clustering Web sessions is to group Web sessions based on similarity and consists of maximizing the intra-
group similarity while minimizing the inter-group similarity．
The first and foremost question needed to be considered in clustering
W b sessions is how to measure the similarity be ...
其他 在LP2900工作平台上
在LP2900工作平台上，利用MAX+plusII开发软件，设计各个模块编程实现基本模型计算机，其中最主要的是CPU的设计。
独立完成运算器的设计，并下载仿真
串口编程 自已用DELPHI编写的MODBUS测试软件及源代码
自已用DELPHI编写的MODBUS测试软件及源代码，需要的朋友可以参考一下。MODBUS 协议为开放式的协议，采用轮询方式。MODBUS分为MODBUS RTU/ASCII、MODBUS TCP、MODBUS PLUS几种，对应于不同的硬件平台，世界上大多数的仪器和仪表，大多数的控制器都采用或支持该协议。学习和掌握本协议，对工控网友来说，非常有意义。 ...
嵌入式/单片机编程 嵌入式编程c、c++
嵌入式编程c、c++，Programming.Embedded.Systems.in.C.and.C.Plus.Plus.eBook-EEn.chm
VHDL/FPGA/Verilog 使用vriloge硬件描述语言设计数字频率计
使用vriloge硬件描述语言设计数字频率计，其对于高频测量精确，可测范围0—99999999HZ，在MAX+PLUSII中运行通过并在实验箱上运行通过达到要求