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软件设计/软件工程 xilinx ise edk8.1注册器
xilinx ise edk8.1注册器
嵌入式/单片机编程 FPGA/CPLD集成开发环境ise的使用详解 示例代码7
FPGA/CPLD集成开发环境ise的使用详解 示例代码7
嵌入式/单片机编程 FPGA/CPLD集成开发环境ise的使用详解 示例代码8
FPGA/CPLD集成开发环境ise的使用详解 示例代码8
嵌入式/单片机编程 FPGA/CPLD集成开发环境ise的使用详解 示例代码9
FPGA/CPLD集成开发环境ise的使用详解 示例代码9
嵌入式/单片机编程 FPGA/CPLD集成开发环境ise的使用详解 示例代码10
FPGA/CPLD集成开发环境ise的使用详解 示例代码10
嵌入式/单片机编程 FPGA/CPLD集成开发环境ise的使用详解 示例代码
FPGA/CPLD集成开发环境ise的使用详解 示例代码
VHDL/FPGA/Verilog 本程序以ISE为开发平台
本程序以ISE为开发平台，采用VHDL为开发语言，实现了对一个时钟信号延时的功能
VHDL/FPGA/Verilog 本程序以XILINX公司的ISE８.２为开发平台
本程序以XILINX公司的ISE８.２为开发平台，采用VHDL为开发语言，实现了对一个时钟信号分频的功能
VHDL/FPGA/Verilog 本程序以XILINX公司的ISE８.２为开发平台
本程序以XILINX公司的ISE８.２为开发平台，采用VHDL为开发语言，实现了一个简单的译码器，适合处学者
其他 用ISE开发的VHDL随机地址发生器,采用循环计数生成地址
用ISE开发的VHDL随机地址发生器,采用循环计数生成地址