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VHDL/FPGA/Verilog CCD信号由于其特殊性,一般不能有信号源产生,本程序采用VHDL语言
CCD信号由于其特殊性,一般不能有信号源产生,本程序采用VHDL语言，以ISE为开发平台，产生了模拟CCD信号的数字信号，只需经DA转换便能实现
VHDL/FPGA/Verilog 本代码介绍了使用VHDL开发FPGA的一般流程
本代码介绍了使用VHDL开发FPGA的一般流程，最终采用了一种基于FPGA的数字频率的实现方法。该设计采用硬件描述语言VHDL，在软件开发平台ISE上完成，可以在较高速时钟频率（100MHz）下正常工作。该设计的频率计能准确的测量频率在1Hz到100MHz之间的信号。使用ModelSim仿真软件对VHDL程序做了仿真，并完成了综合布局布线，最终 ...
系统设计方案 本文：采用了FPGA方法来模拟高动态(Global Position System GPS)信号源中的C／A码产生器。C／A码在GPS中实现分址、卫星信号粗捕和精码(P码)引导捕获起着重要的作用
本文：采用了FPGA方法来模拟高动态(Global Position System GPS)信号源中的C／A码产生器。C／A码在GPS中实现分址、卫星信号粗捕和精码(P码)引导捕获起着重要的作用，通过硬件描述语言VERILOG在ISE中实现电路生成，采用MODELSIM、SYNPLIFY工具分别进行仿真和综合。 ...
系统设计方案 本系统使用VHDL语言进行设计
本系统使用VHDL语言进行设计，采用自上向下的设计方法。目标器件选用Xilinx公司的FPGA器件，并利用Xilinx ISE 7.1 进行VHDL程序的编译与综合，然后用Modelsim Xilinx Edition 6.1进行功能仿真和时序仿真。
电子书籍 ise6.1的中文说明
ise6.1的中文说明，能够在较短的时间内熟悉ise
VHDL/FPGA/Verilog 4 digital LED dynamic display的Verilog HDL源代码
4 digital LED dynamic display的Verilog HDL源代码，它能动态的显示4位数，为FPGA 的DEBUG 提供便利，非常经典，简单易懂，并且经过了Modelsim/ISE/FPGA(XC3S250ETQ144)验证和实现，好的行为模型就应该大家分享。
其他嵌入式/单片机内容 图像处理
图像处理，实现一个显示器接口，实现了编码和解码
使用方法：
1.拷贝到硬盘，用ISE打开工程文件即可。
VHDL/FPGA/Verilog 这是个USB 的VHDL 程序
这是个USB 的VHDL 程序，进去直接双击ISE 就可以用了
VHDL/FPGA/Verilog 在SPARTAN 3E开发平台上
在SPARTAN 3E开发平台上，利用其板子上一些I/O口或LED来实现PWM的设计
上传文件中pwm_ctrl是用picoblaze实现的PWM控制文件，另外一个则是在ISE设计中的顶层文件。
VHDL/FPGA/Verilog 16×4bit的FIFO设计,VHDL语言编的的
16×4bit的FIFO设计,VHDL语言编的的，能在ISE上仿真出来结果。