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IP核设计 的查询结果
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VHDL/FPGA/Verilog 利用FPGA实现DDS经过编译没有错误。编译环境为QuartusII7.2
利用FPGA实现DDS经过编译没有错误。编译环境为QuartusII7.2，该环境集成了IP核，可以提高开发效率。
加密解密 AES算法的verilog代码
AES算法的verilog代码，即AES算法IP核
接口技术 德国SICK公司Hiperface接口技术文档
德国SICK公司Hiperface接口技术文档，详细给出了DSL接口通讯协议、硬件接口、参考电路以及IP核使用方法等内容
源码 联合DDS IP核FFT IP核进行仿真
用xilinxIP联合modelsim进行仿真
技术资料 CYCLONE IV 兼容黑金开发板AC4075
DDR3等长处理，LVDS差分线等长处理，完整的地平面，足够的电源去耦电容，核心板尺寸6CMx6CM!FPGA型号:EP4CE75F23C8DDR2:两片DDR2 2GBitsFLASH:64MBits预留IO:168个单端IOLVDS:可以配置为支持该协议USB接口：可以直接和主机进行USB数据通讯NIOS处理器：可以通过软核设计支持运行LINUX 操作系统，或者运行NIOS SDKALONE程序 ...
学术论文 基于ARM核的USB2.0AHB接口IP主机端驱动程序的设计与实现
本论文以开发基于ARM核的USB2.0-AHB接口IP此项目为依托，致力于在Windows XP操作系统上使用DDK(Driver Development Kit)设计和开发一个基于WDM的主机端驱动程序。开发该驱动程序的目的是为了对该IP进行FPGA测试以及配合设备端驱动程序的开发，该驱动程序能够完成即插即用功能，块传输，同步传输，控制传输以及对Flash的操作 ...