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IP核设计 的查询结果
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VHDL/FPGA/Verilog MP3 for XPLA3 XILINX.CPLD,必须在XILINX的FPGA芯片下使用,因为IP核是xilinx
MP3 for XPLA3 XILINX.CPLD,必须在XILINX的FPGA芯片下使用,因为IP核是xilinx
VHDL/FPGA/Verilog 借助于altera公司的IP核
借助于altera公司的IP核，在FPGA中使用dspbuilder实现32位低通FIR滤波器功能，
VHDL/FPGA/Verilog vhdl语言编写的AVR单片机IP核
vhdl语言编写的AVR单片机IP核，里面有testbench和说明文档。
VHDL/FPGA/Verilog can控制器IP核
can控制器IP核，verilog语言描述实现。含测试例
软件设计/软件工程 里面包含15个altera的IP核的源代码,包括I2C
里面包含15个altera的IP核的源代码,包括I2C，UART，VGA_SYN
USB编程 usb1.1 ip核
usb1.1 ip核，使用verilog编写
VHDL/FPGA/Verilog 实现fft的ip核
实现fft的ip核，用vhdl语言实现。
VHDL/FPGA/Verilog wishbone总线的VHDL源代码 wishbone适用于与FPGA中IP核的高速通信
wishbone总线的VHDL源代码
wishbone适用于与FPGA中IP核的高速通信，其接口简单，速度快 成为ip通信的主流
VC书籍 i2c IP核 i2c.master i2c.mater.v
i2c IP核
i2c.master
i2c.mater.v
VHDL/FPGA/Verilog VERILOG VERSION PIC16C57 是一个用于FPGA模拟PIC16C57的IP核
VERILOG VERSION PIC16C57
是一个用于FPGA模拟PIC16C57的IP核，有帮助文件，介绍了如何测试使用这个IP核。用VERILOG语言编写的。