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IP核设计 的查询结果
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VHDL/FPGA/Verilog 描述了一个8位二进制输入的DAC 文章中包含源代码 采用数字化技术、在测控系统中用IP核实现D/A转换
描述了一个8位二进制输入的DAC
文章中包含源代码
采用数字化技术、在测控系统中用IP核实现D/A转换，并且在1片可编程逻辑器件中实现。它不受温度的影响，既可保持高分辨率，又可降低对电路精度和稳定度的要求，并减少元件的数量。 ...
VHDL/FPGA/Verilog 基于CPLD/FPGA的SPI控制的IP核的实现spi_master
基于CPLD/FPGA的SPI控制的IP核的实现spi_master
VHDL/FPGA/Verilog 基于VHDL语言的IP核验证
基于VHDL语言的IP核验证
VHDL/FPGA/Verilog Altera IP应用设计实例  “Example-b4-2Project”目录下为设计工程  “Example-b4-2Solution”目录下为正确的解决方案
Altera IP应用设计实例
 “\Example-b4-2\Project”目录下为设计工程
 “\Example-b4-2\Solution”目录下为正确的解决方案，仅供读者参考
其他书籍 该文档介绍的是IP核的使用方法
该文档介绍的是IP核的使用方法，主要是ISE中的IP核
其他 该文件包含以太网IP核的相关代码
该文件包含以太网IP核的相关代码，一共包含24个VERILOG源代码
VHDL/FPGA/Verilog 基于ep3c25的altera sdi ip核的使用
基于ep3c25的altera sdi ip核的使用，串并转换和并串转换
VHDL/FPGA/Verilog ip核
ip核，蓝牙bluetooth的fpga硬件实现
VHDL/FPGA/Verilog 视频压缩的ip核
视频压缩的ip核，针对fpga开发的系统
VHDL/FPGA/Verilog fpga的usb1.1 ip核
fpga的usb1.1 ip核，硬件实现