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VHDL/FPGA/Verilog 异步FIFO控制器的设计 主要用于异步先进先出控制器的设计。 所用语言Verilog HDL.
异步FIFO控制器的设计
主要用于异步先进先出控制器的设计。
所用语言Verilog HDL.
VHDL/FPGA/Verilog D触发器的设计 主要用在时序电路中。 所用语言为Verilog HDL.
D触发器的设计
主要用在时序电路中。
所用语言为Verilog HDL.
VHDL/FPGA/Verilog 用一位全加器组成四位全加器. 所用语言是Verilog HDL. 主要用在加法器的设计中。
用一位全加器组成四位全加器.
所用语言是Verilog HDL.
主要用在加法器的设计中。
VHDL/FPGA/Verilog 指令译码电路的设计。 主要用在数字电路的设计中。 所用语言为Verilog HDL.
指令译码电路的设计。
主要用在数字电路的设计中。
所用语言为Verilog HDL.
Java书籍 ＪＡＶＡ各种游戏大综合！各种特效
ＪＡＶＡ各种游戏大综合！各种特效，最后版本！可以加入您的游戏和作品里面，给你增添色彩！有任何问题请给我留言
微处理器开发 这是基于博创公司ARM3000平台设计的综合实验源代码－电子菜单
这是基于博创公司ARM3000平台设计的综合实验源代码－电子菜单，已经调试通过
微处理器开发 这也是基于博创公司ARM3000平台设计的综合实验源代码－计算器
这也是基于博创公司ARM3000平台设计的综合实验源代码－计算器，也已经调试运行通过。
微处理器开发 这也是基于博创公司ARM3000平台设计的综合实验源代码－世界时钟
这也是基于博创公司ARM3000平台设计的综合实验源代码－世界时钟，也已经调试运行通过。
游戏 PS2游戏硬盘直灌（HDL）的Windows下VC的源代码
PS2游戏硬盘直灌（HDL）的Windows下VC的源代码，根据HDUMP修改的（改正了几处错误）。命令行方式执行，具体使用说明可在命令行中看到。HDP.exe是执行程序。
VHDL/FPGA/Verilog 11,13,16位超前进位加法器的Verilog HDL源代码。
11,13,16位超前进位加法器的Verilog HDL源代码。