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教程资料  FPGA 数字电路时序时延路径建立时间保持时间

关键词：FPGA 数字电路时序时延路径建立时间保持时间

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教程资料  采用FPGA模拟高动态GPS信号源中的C／A码产生器

本文：采用了FPGA方法来模拟高动态(Global Position System GPS)信号源中的C／A码产生器。C／A码在GPS中实现分址、卫星信号粗捕和精码(P码)引导捕获起着重要的作用，通过硬件描述语言VERILOG在ISE中实现电路生成，采用MODELSIM、SYNPLIFY工具分别进行仿真和综合。 ...

https://www.eeworm.com/dl/fpga/doc/18520.html

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教程资料  FPGA-based_oscilloscope,VHDL写的实现示波器的程序

FPGA-based_oscilloscope,VHDL写的实现示波器的程序，及完整的工程描述文档

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教程资料  一个fpga开发板的原理图具有led灯、ram、flash

一个fpga开发板的原理图，此板具有led灯、ram、flash

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教程资料  脉冲压缩技术是指对雷达发射的宽脉冲信号进行调制(如线性调频、非线性调频、相位编码)

脉冲压缩技术是指对雷达发射的宽脉冲信号进行调制(如线性调频、非线性调频、相位编码)，并在接收端对回波宽脉冲信号进行脉冲压缩处理后得到窄脉冲的实现过程。脉冲压缩有效地解决了雷达作用距离与距离分辨率之间的矛盾，可以在保证雷达在一定作用距离下提高距离分辨率。\r\n ...

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教程资料  EDA高手入门必看-FPGA-CPLD-开发流程

EDA高手入门必看，FPGA-CPLD-开发流程。

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教程资料  Median Filter 在FPGA中的实现

Median Filter 在FPGA中的实现

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教程资料  本压缩文件包含：使用VHDL来实现对LED的静态显示

本压缩文件包含：使用VHDL来实现对LED的静态显示，实现对LED的动态显示。

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教程资料  基于CPLD的USB下载电缆设计

基于CPLD的USB下载电缆设计.rar

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教程资料  FPGA-CPLD_DesignTool,事例程序3-4

FPGA-CPLD_DesignTool,事例程序3-4陆续上传请需要的朋友下载

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