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可编程逻辑 基于FPGA的RS码译码器的设计
介绍了符合CCSDS标准的RS（255，223）码译码器的硬件实现结构。译码器采用8位并行时域译码算法，主要包括了修正后的无逆BM迭代译码算法，钱搜索算法和Forney算法。采用了三级流水线结构实现，减小了译码器的时延，提高了译码的速率，使用了VHDL语言完成译码器的设计与实现。测试表明，该译码器性能优良，适用于高速通信。
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可编程逻辑 Xilinx FPGA集成电路的动态老化试验
3 FPGA设计流程
完整的FPGA 设计流程包括逻辑电路设计输入、功能仿真、综合及时序分析、实现、加载配置、调试。FPGA 配置就是将特定的应用程序设计按FPGA设计流程转化为数据位流加载到FPGA 的内部存储器中，实现特定逻辑功能的过程。由于FPGA 电路的内部存储器都是基于RAM 工艺的，所以当FPGA电路电源掉电后， ...
可编程逻辑 FPGA在新型激光光幕靶中的应用
结合坐标采集和处理在新型激光光幕靶中的应用，针对传统激光光幕靶处理器I/O紧缺、处理速度慢、存在错报、漏报，无法测试子弹连发坐标等问题，提出了一种以FPGA为核心的坐标采集和处理系统的设计方法。设计中采用了自顶向下的设计方法，将该系统依据逻辑功能划分为3个模块，并在ISE 14.1和Modelsim中进行设计、编译、仿真， ...
可编程逻辑 颠覆未来：基于FPGA的可重构计算机
颠覆未来：基于FPGA的可重构计算机，畅想了可重构计算机的未来
可编程逻辑 基于FPGA的DDS杂散分析及抑制方法
首先介绍了采用直接数字频率合成（DDS）技术的正弦信号发生器的基本原理和采用FPGA实现DDS信号发生器的基本方法，然后结合DDS的原理分析了采用DDS方法实现的正弦信号发生器的优缺点，其中重点分析了幅度量化杂散产生的误差及其原因，最后针对DDS原理上存在的幅度量化杂散，利用FPGA时钟频率可调的特点，重点提出了基于FPGA ...
可编程逻辑 基于FPGA的多功能频率计的设计
基于Altera公司FPGA芯片EP2C8Q208，嵌入MC8051 IP Core，用C语言对MC8051 IP Core进行编程，以其作为控制核心，实现系统控制。在FPGA芯片中，利用Verilog HDL语言进行编程，设计了以MC8051 IP Core为核心的控制模块、计数模块、锁存模块和LCD显示模块等几部分，实现了频率的自动测量，测量范围为0.1Hz~50MHz，测量误差0.01% ...
可编程逻辑 Altium Designer6.0 中文版 FPGA设计教程
Altium Designer6.0 中文版 FPGA设计教程
可编程逻辑 利用Verilog_HDL实现基于FPGA的分频方法
利用Verilog_HDL实现基于FPGA的分频方法
可编程逻辑 Altera公司 Cyclone V 28nm FPGA功耗优势
Cyclone V FPGA功耗优势：采用低功耗28nm FPGA活的最低系统功耗（英文资料）
可编程逻辑 Altera公司SoC FPGA产品简介高级信息摘要
Altera公司SoC FPGA产品简介高级信息摘要(英文资料)
图 硬件处理系统