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VHDL/FPGA/Verilog 基于CYCLONE II的程序,DDS原理的函数信号发生器.采用查表法实现.各位可以参考.
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VHDL/FPGA/Verilog 基于CYCLONG II的自己编的电子时钟.早期作品了,可能这方面的资料也比较多,但是个人思路不同,希望我的程序能给朋友们提供些须帮助.
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VHDL/FPGA/Verilog 不错的Quartus II 与modelsim结合仿真简介笔记
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嵌入式/单片机编程 这是基于UCOS-II嵌入式实时操作系统开发的脑中报警程序代码
这是基于UCOS-II嵌入式实时操作系统开发的脑中报警程序代码，已经通过在开发板上的测试