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利用cadence软件做的常用器件的封装。
技术书籍 VerilogHDL数字设计与综合夏宇闻译（第二版）
Verilog HDL是一种硬件描述语言（HDL:Hardware Discription Language），是一种以文本形式来描述数字系统硬件的结构和行为的语言，用它可以表示逻辑电路图、逻辑表达式，还可以表示数字逻辑系统所完成的逻辑功能。 Verilog HDL和VHDL是目前世界上最流行的两种硬件描述语言，都是在20世纪80年代中期开发出来的。前者由Gatewa ...
其他文档 利用Cadence ALlegro进行PCB级的信号完整性仿真
随着信息宽带化和高速化的发展，以前的低速PCB已完全不能满足日益增长信息化发展的需要，而高速PCB的出现将对硬件人员提出更高的要求，仅仅依靠自
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学术论文 交织与解交织的算法研究及FPGA实现
本文主要研究了数字声音广播系统(DAB)内交织器与解交织器的算法及硬件实现方法。时间交织器与解交织器的硬件实现可以有几种实现方案，本文对其性能进行了分析比较，选择了一种工程中实用的设计方案进行设计，并将设计结果以FPGA设计验证。时间解交织器的交织速度、电路面积、占用内存、是设计中主要因素，文中采用了单口SRA ...
技术教程 Pspice中变压器的使用
教你如何在Cadence Pspice中使用变压器
IC设计软件 Cadence spectra 16.30
SPECCTRA 提供设计师一种以形状为基础的，功能强大的绕线器，可在减少使用者介入情况下完成各种复杂设计。