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DSP编程 基于DSP的LoG边缘检测系统的设计与实现

近年来,随着DSP技术的快速发展,数字视频处理技术得到了越来越广泛的应用。边缘检测是是数字视频处理中的一项关键技术,而且是进行对象检测和识别的基础。本文首先分析了当前发展比较成熟的几种边缘检测算法,然后针对基于DSP的数字视频处理系统的特点选用Laplacian of Gaussian(LoG)边缘检测算法,并在基于DM642的数字 ...
https://www.eeworm.com/dl/516/31835.html
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DSP编程 基于DSP和FPGA的汽车防撞高速数据采集系统

随着信息技术的不断发展,数据采集技术已成为重要的现代化的工具,并且其应用范围也在不断扩大,在通信、雷达、医疗、遥测遥感等领域得到了广泛的应用。本文为了汽车防撞报警设备高速信号处理的目的,采用了DSP和FPGA处理器加上相关算法,实现了对激光雷达回波信号能够高速的采集和处理。 ...
https://www.eeworm.com/dl/516/31876.html
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DSP编程 DSP在嵌入式阀门控制器中的应用

DSP是高集成、高性能指令控制应用芯片,在阀门控制器中根据控制需求采用TMS320F2812作为嵌入式处理器核心单元。文中从应用角度出发设计分析了处理机电路特点,其中电路设计综合了DSP芯片特点和可靠性要求,并最终设计实现了理想的性能。 ...
https://www.eeworm.com/dl/516/31917.html
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DSP编程 基于DSP的三相异步电机节能控制技术研究

介绍了基于TMS320F2812 DSP芯片的节能控制技术的研究。利用TMS320F2812强大的计算能力,根据电机输入电压、电流的过零点计算出实际功率因数角,比较最佳功率因数角的目标值,调整输出触发脉冲,使电机以最佳功率因数状态运行,以达到电机节能高效的控制目标 ...
https://www.eeworm.com/dl/516/31920.html
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DSP编程 基于DSP的单相Boost型数字PFC控制技术

为了减少电力电子装置对电网引起的谐波污染,在变频器接入电网之前加入PFC电路是一种趋势。讨论了基于TMS320LF2407的全数字控制的单相PFC电路的工作原理,并由此得到了主电路参数的选取原则;建立了单相Boost型数字PFC的小信号动态模型,并分析了基于该模型的数字控制设计方法,给出了设计软件流程;最后搭建了一台样机,在实际 ...
https://www.eeworm.com/dl/516/31981.html
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教程资料 基于布隆过滤器的字符串模糊匹配算法的FPGA实现

 深度包检测技术通过对数据包内容的深入扫描和检测,能够有效识别出隐藏在数据包有效载荷内的非法数据,但该技术存在功耗非常大的缺点。针对该问题,提出了采用Bloom Filter(布隆过滤器)进行字符串模糊匹配方式,利用Bloom Filter将信息流中大部分正常流量过滤掉,从而减轻了后端的字符串精确匹配的压力,降低了系统 ...
https://www.eeworm.com/dl/fpga/doc/32086.html
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教程资料 JPEG2000数据压缩的FPGA实现

高性能的数据压缩可以有效的减少数据对存储空间和通信带宽的要求,降低通信成本。为解决图像数据的高压缩性能问题,本文提出了基于JPEG2000标准的数据压缩系统的FPGA实现方案。相对于软件算法实现和其他硬件方法,采用FPGA硬件实现可降低系统复杂度提高性能。最终设计的IP核具有资源占用少,性能良好和便于扩展等优点,能够 ...
https://www.eeworm.com/dl/fpga/doc/32137.html
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教程资料 基于FPGA的RS码译码器的设计

介绍了符合CCSDS标准的RS(255,223)码译码器的硬件实现结构。译码器采用8位并行时域译码算法,主要包括了修正后的无逆BM迭代译码算法,钱搜索算法和Forney算法。采用了三级流水线结构实现,减小了译码器的时延,提高了译码的速率,使用了VHDL语言完成译码器的设计与实现。测试表明,该译码器性能优良,适用于高速通信。 ...
https://www.eeworm.com/dl/fpga/doc/32211.html
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教程资料 在Altera 28nm FPGA上解决100-GbE线路卡设计挑战

支持40 GbE、100 GbE和Interlaken的高密度硬核MLD/PCS模块,从而提高系统集成度。 宽带数据缓冲,提供1,600-Mbps外部存储器接口。 数据包处理和流量管理功能的高效实现。 更高的系统性能,同时保持功耗和成本预算不变。 ...
https://www.eeworm.com/dl/fpga/doc/32370.html
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教程资料 WP370 -采用智能时钟门控技术降低动态开关功耗

    赛灵思推出业界首款自动化精细粒度时钟门控解决方案,该解决方案可将 Virtex®-6 和 Spartan®-6 FPGA 设计方案的动态功耗降低高达 30%。赛灵思智能时钟门控优化可自动应用于整个设计,既无需在设计流程中添加更多新的工具或步骤,又不会改变现有逻辑或时钟,从而避免设计修改。此外,在大多数情况下 ...
https://www.eeworm.com/dl/fpga/doc/32629.html
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