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CLock 的查询结果
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单片机开发 K3:--- P1.6 K4:--- P1.7 BEEP:--- P3.7 K3 --- 控制按键 K4 --- 清零按键 开机显示： SECOND-CLOCK 0 TIM
K3:--- P1.6
K4:--- P1.7
BEEP:--- P3.7
K3 --- 控制按键
K4 --- 清零按键
开机显示：
SECOND-CLOCK 0
TIME 00:00:00:00
K3 --- 控制按键：
第一次按下时,开始计时。
显示
BEGIN COUNT 1
TIME 00:00:01:88
第二次按下时,暂停计时。
显示
PAUST COUNT 2
TIME 00:00:01:88
第三次按下时,累计计时。
显示
...
数据结构 这是编写的一个操作系统的clock算法。是在vc++环境下编绎的。
这是编写的一个操作系统的clock算法。是在vc++环境下编绎的。
单片机开发 c8051f020 实时时钟模块程序 内含IIC模块程序/********************** SYSTEM CLOCK 8M********************************/
c8051f020 实时时钟模块程序 内含IIC模块程序/********************** SYSTEM CLOCK 8M********************************/
extern unsigned char xdata currenttime[16]={0}
extern unsigned char xdata settime[16]={
0x00, // control regesiter 1
0x00, // control regesiter 2
0x01, / ...
单片机开发 clock 源程序c lock 源程序 clock 源程序c lock 源程序
clock 源程序c lock 源程序
clock 源程序c lock 源程序
VHDL/FPGA/Verilog Digital Clock in Assembly 我的一个大学满分VHDL作品
Digital Clock in Assembly
我的一个大学满分VHDL作品，数字石英钟的模拟程序。
汇编语言 芯片为EM78P153 P64,P65接晶振,振荡模式为4MHz晶振 看门狗关,指令周期为2个CLOCK,P63为复位脚
芯片为EM78P153
P64,P65接晶振,振荡模式为4MHz晶振
看门狗关,指令周期为2个CLOCK,P63为复位脚
VHDL/FPGA/Verilog My thesis entitled "fpga digital clock," immature, to enlighten
My thesis entitled "fpga digital clock," immature, to enlighten
Java编程 时钟万年历代码 Clock.java放在了一个名叫 Clock的包里
时钟万年历代码 Clock.java放在了一个名叫 Clock的包里
单片机开发 * This a software code module for a time-of-day clock object. * The clock may be fixed 12-hour, fi
* This a software code module for a time-of-day clock object.
* The clock may be fixed 12-hour, fixed 24-hour, or dynamically
* configurable between these two types. Clock data can be accessed
* as a binary number representing the number of minutes since midnight
* or a BCD number formatted acco ...
uCOS Dallas RTC （Real Time Clock）code 的源码
Dallas RTC （Real Time Clock）code 的源码