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ARM 基于Virtex5的PCI接口电路
PCI Express是由Intel，Dell，Compaq，IBM，Microsoft等PCI SIG联合成立的Arapahoe Work Group共同草拟并推举成取代PCI总线标准的下一代标准。PCI Express利用串行的连接特点能轻松将数据传输速度提到一个很高的频率，达到远远超出PCI总线的传输速率。一个PCI Express连接可以被配置成x1，x2，x4，x8，x12，x16和x32的数据 ...
可编程逻辑 PLB Block RAM(BRAM)接口控制器
基于RAM块的应用
可编程逻辑 XAPP228 -Virtex器件内的四端口存储器
This application note describes how the existing dual-port block memories in the Spartan™-IIand Virtex™ families can be used as Quad-Port memories. This essentially involves a dataaccess time (halved) versus functionality (doubled) trade-off. The overall bandwidth of the blockmemory in ...
可编程逻辑 PLB Block RAM(BRAM)接口控制器
The PLB BRAM Interface Controller is a module thatattaches to the PLB (Processor Local Bus).
可编程逻辑 DS306-PPC405 Virtex-4 Wrapper
The PPC405 Virtex-4 is a wrapper around the Virtex-4PowerPC™ 405 Processor Block primitive. For detailsregarding the PowerPC 405, see the PowerPC 405 ProcessorBlock Reference Guide.
可编程逻辑 XAPP740利用AXI互联设计高性能视频系统
This application note covers the design considerations of a system using the performance
features of the LogiCORE™ IP Advanced eXtensible Interface (AXI) Interconnect core. The
design focuses on high system throughput through the AXI Interconnect core with F
MAX
 and
area optimizat ...
可编程逻辑 状态机学习心得
FSM 分两大类：米里型和摩尔型。
组成要素有输入(包括复位)，状态(包括当前状态的操作)，状态转移条件，状态的输出条件。
设计FSM 的方法和技巧多种多样，但是总结起来有两大类：第一种，将状态转移和状态的操作和判断等写到一个模块(process、block)中。另一种是将状态转移单独写成一个模块，将状态的操作和判 ...
可编程逻辑 Xilinx FPGA全局时钟资源的使用方法
目前，大型设计一般推荐使用同步时序电路。同步时序电路基于时钟触发沿设计，对时钟的周期、占空比、延时和抖动提出了更高的要求。为了满足同步时序设计的要求，一般在FPGA设计中采用全局时钟资源驱动设计的主时钟，以达到最低的时钟抖动和延迟。 FPGA全局时钟资源一般使用全铜层工艺实现，并设计了专用时钟缓冲与驱动结构 ...
matlab例程 This model simulates a CDMA2000 1xRTT Forward link (between Base Station and Mobile Station). In par
This model simulates a CDMA2000 1xRTT Forward link (between Base Station and Mobile Station). In particular, it simulates the Radio Configuration 3 of a Forward Fundamental channel. The block CDMA2k: Initial settings allows you to set different parameters such as data rate, Power Control SubChannel ...