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8位MCU 的查询结果
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VHDL/FPGA/Verilog 这是我最近买的一套CPLD开发板VHDL源程序并附上开发板的原理图,希望对你是一个很好的帮助!其中内容为:8位优先编码器,乘法器,多路选择器,二进制转BCD码,加法器,减法器,简单状态机,四位比较器,
这是我最近买的一套CPLD开发板VHDL源程序并附上开发板的原理图,希望对你是一个很好的帮助!其中内容为:8位优先编码器,乘法器,多路选择器,二进制转BCD码,加法器,减法器,简单状态机,四位比较器,7段数码管,i2c总线,lcd液晶显示,拨码开关,串口,蜂鸣器,矩阵键盘,跑马灯,交通灯,数字时钟. ...
VHDL/FPGA/Verilog SHIFT_8REG是8位的一个具有移位功能的寄存器
SHIFT_8REG是8位的一个具有移位功能的寄存器，每一次数据打入都会从这个寄存器的最低位打入，并相应进行向左移位。
ODD_110BREG是一个3位的备份寄存器，寄存器中存放的是奇数帧的同步头，也就是110。
EVEN_9BHREG是一个8位的备份寄存器，寄存器中存放的是偶数帧的同步头，也就是10011011。这两个寄存器的初始值在系统一开始 ...
其他 可以将以bit为单位进行处理的算法扩展到8位
可以将以bit为单位进行处理的算法扩展到8位，即以Byte为单位进行处理。由于有8个bit，所以有2^8种选择。这样明显会使运行时
间大为减少，速度明显更快，但是也有它的缺点，即，占用资源太大，所以综合考虑速度和 资源两点，采用半字节查表法。即以半
Byte为单位进行处理。由于有4个bit，所以有2^4种选择。 ...
VHDL/FPGA/Verilog 简单的8位CPU
简单的8位CPU，内含PDF文件.可自己查看详细说明
嵌入式/单片机编程 通用ASK信号解码接收程序 1. 接收数据位数最多为40(5*8)位. 2. 由定时器对time进行渐增,在TCC中断程序中加入"INC TIME". 3. 宽脉冲最大允许时间和最小
通用ASK信号解码接收程序
1. 接收数据位数最多为40(5*8)位.
2. 由定时器对time进行渐增,在TCC中断程序中加入"INC TIME".
3. 宽脉冲最大允许时间和最小允许时间的计算方式:
脉冲允许时间=TCC 中断时间(us)*设定数据
4. 在接收到完整的数据后建立rx_data_ok标志.
5. 该子程序由主程序调用.
6. 数据格式:rx_data5 ...
VHDL/FPGA/Verilog 节约资源型 8位*8位 运算VHDL代码
节约资源型 8位*8位 运算VHDL代码，采用串行运算，8 个时钟周期完成一次运算。QUARTUS下已验证
VHDL/FPGA/Verilog 本文件提供了用verilog HDL语言实现的8位超前进位加法器,充分说明了超前进位加法器和普通加法器之间的区别.
本文件提供了用verilog HDL语言实现的8位超前进位加法器,充分说明了超前进位加法器和普通加法器之间的区别.
文章/文档 我自己写的带有异步清零端的8位可预置移位寄存器
我自己写的带有异步清零端的8位可预置移位寄存器
单片机开发 可预置的8位计数器程序的主要部分分析
可预置的8位计数器程序的主要部分分析，用C语言开发！
其他 高性能、低功耗的8 位AVR® 微处理器 • 先进的RISC 结构
高性能、低功耗的8 位AVR® 微处理器
• 先进的RISC 结构，JTAG 接口( 与IEEE 1149.1 标准兼容)