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VHDL/FPGA/Verilog 简单的8位CPU
简单的8位CPU，内含PDF文件.可自己查看详细说明
matlab例程 CrossPointNo=53 ％％％输入图中节点的总数目 对已知的边进行赋值
CrossPointNo=53 ％％％输入图中节点的总数目
对已知的边进行赋值，注意：有向图的Cost(i,j)=Cost(j,i)
软件设计/软件工程 十二、软件问题报告 1．登记号 1 2．登记日期 1 3．问题发现日期 1 4．活动 2 5．状态 2 6．报告人 2 7．问题属于什么方面 2 8．模块/子系统 2 9．修订版
十二、软件问题报告
1．登记号 1
2．登记日期 1
3．问题发现日期 1
4．活动 2
5．状态 2
6．报告人 2
7．问题属于什么方面 2
8．模块/子系统 2
9．修订版本号 2
10．磁带 2
11．数据库 2
12．文件号 2
13．测试用例 2
14．硬件 2
15．问题描述/影响 2
16．附注 2 ...
软件设计/软件工程 十三、软件修改报告 1．登记号 1 2．登记日期 1 3．时间 2 4．报告人 2 5．子系统名 2 6．模块名 2 7．“软件修改报告”的编号 2 8．修改 2 9．修改描述
十三、软件修改报告
1．登记号 1
2．登记日期 1
3．时间 2
4．报告人 2
5．子系统名 2
6．模块名 2
7．“软件修改报告”的编号 2
8．修改 2
9．修改描述 2
10．批准人 2
11．语句类型 2
12．程序名 2
13．老修订版 2
14．新修订版 2
15．数据库 2
16．数据库修改报告 2
17．文件 2
18．文件更新 2
19．修改是否已测试 2
20 ...
嵌入式/单片机编程 通用ASK信号解码接收程序 1. 接收数据位数最多为40(5*8)位. 2. 由定时器对time进行渐增,在TCC中断程序中加入"INC TIME". 3. 宽脉冲最大允许时间和最小
通用ASK信号解码接收程序
1. 接收数据位数最多为40(5*8)位.
2. 由定时器对time进行渐增,在TCC中断程序中加入"INC TIME".
3. 宽脉冲最大允许时间和最小允许时间的计算方式:
脉冲允许时间=TCC 中断时间(us)*设定数据
4. 在接收到完整的数据后建立rx_data_ok标志.
5. 该子程序由主程序调用.
6. 数据格式:rx_data5 ...
汇编语言 LED实验 以8255为输出口,控制8个单色LED灯
LED实验
以8255为输出口,控制8个单色LED灯
其他 8点基二fft Fast Fourier Transform (FFT). Using 8 points, takes about 1.2 ms to execute one FFT. Se
8点基二fft
Fast Fourier Transform (FFT).
Using 8 points, takes about 1.2 ms to execute one FFT.
Sets up General Purpose Timer 1 to generate events at 10 kHz.
Will produce 10 kHz output on T1PWM and T1PWM pins.
VHDL/FPGA/Verilog 节约资源型 8位*8位 运算VHDL代码
节约资源型 8位*8位 运算VHDL代码，采用串行运算，8 个时钟周期完成一次运算。QUARTUS下已验证
行业发展研究 1.农机使用与维修 2、农机使用与维修 3、汽车电器 4、农机具之友 5、职业技术教育 6、农机使用与维修 7、上海汽车 8、现代机械
1.农机使用与维修
2、农机使用与维修
3、汽车电器
4、农机具之友
5、职业技术教育
6、农机使用与维修
7、上海汽车
8、现代机械
VHDL/FPGA/Verilog 本文件提供了用verilog HDL语言实现的8位超前进位加法器,充分说明了超前进位加法器和普通加法器之间的区别.
本文件提供了用verilog HDL语言实现的8位超前进位加法器,充分说明了超前进位加法器和普通加法器之间的区别.