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405 的查询结果
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学术论文 基于FPGA的嵌入式系统的设计
本论文来自于863项目基于光互连自组织内存服务体系(简称MemoryBox)。本文主要研究Memory Box系统中基于可重配置计算架构，软硬件携同设计方法，在XILINX VIRTEX 2 Pro FPGA上设计实现嵌入式系统。由于嵌入式系统是Memory Box工作的平台，所以硬件应具有良好的扩展性、灵活性，软件应具有优良的稳定性。在硬件平台选型时，我 ...
单片机编程 Adobe dreamweaver cs5 序列号注册机
Adobe Dreamweaver cs5是个原本由Macromedia公司所开发的著名网站开发工具。它使用所见即所得的接口，亦有HTML编辑的功能。它现在有Mac和Windows系统的版本。
Adobe Dreamweaver CS5.5
软件大小：405.29 MB
开发商：Adobe
软件语言：英文版
授权类型：共享(收费)软件
软件类别：国外软件/ ...
单片机编程 c#入门经典第4版全书pdf
《C#入门经典(第4版)》通过C#可以很容易地学习.NET Framework 3.5的强大功能，所以C#是开始您编程生涯的绝佳方式。《C#入门经典(第4版)》全面阐述了C#编程的所有方面，包括C#语言本身、Windows编程、Web编程及数据源的使用等内容。学习了新的编程技巧后，《C#入门经典(第4版)》介绍了如何高效地部署应用程序和服务，论述 ...
教程资料 XAPP806 -决定DDR反馈时钟的最佳DCM相移
This application note describes how to build a system that can be used for determining theoptimal phase shift for a Double Data Rate (DDR) memory feedback clock. In this system, theDDR memory is controlled by a controller that attaches to either the OPB or PLB and is used inan embedded microproces ...
教程资料 XAPP719 -利用USR_ACCESS寄存器实现PowerPC高速缓存配置
The Virtex™-4 user access register (USR_ACCESS_VIRTEX4) is a 32-bit register thatprovides direct access to bitstream data by the FPGA fabric. It is useful for loadingPowerPC™ 405 (PPC405) processor caches and/or other data into the FPGA after the FPGAhas been configured, thus achieving ...
教程资料 DS306-PPC405 Virtex-4 Wrapper
The PPC405 Virtex-4 is a wrapper around the Virtex-4PowerPC™ 405 Processor Block primitive. For detailsregarding the PowerPC 405, see the PowerPC 405 ProcessorBlock Reference Guide.
通信网络 XAPP807-封装最小的三态以太网MAC处理引擎
The Tri-Mode Ethernet MAC (TEMAC) UltraController-II module is a minimal footprint,embedded network processing engine based on the PowerPC™ 405 (PPC405) processor coreand the TEMAC core embedded within a Virtex™-4 FX Platform FPGA. The TEMACUltraController-II module connects to an exte ...
嵌入式综合 基于VME总线的以太网接口设备
本文介绍的系统是一个以PowerPC 405为微处理器，基于VME总线的以太网接口设备，它通过以太网和VME总线接口，实现VME系统与外部局域网的实时数据交换。
可编程逻辑 XAPP806 -决定DDR反馈时钟的最佳DCM相移
This application note describes how to build a system that can be used for determining theoptimal phase shift for a Double Data Rate (DDR) memory feedback clock. In this system, theDDR memory is controlled by a controller that attaches to either the OPB or PLB and is used inan embedded microproces ...
可编程逻辑 XAPP719 -利用USR_ACCESS寄存器实现PowerPC高速缓存配置
The Virtex™-4 user access register (USR_ACCESS_VIRTEX4) is a 32-bit register thatprovides direct access to bitstream data by the FPGA fabric. It is useful for loadingPowerPC™ 405 (PPC405) processor caches and/or other data into the FPGA after the FPGAhas been configured, thus achieving ...