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4位乘法器 的查询结果
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单片机编程 采用MSP430设计的12位心电(ECG)放大器
采用MSP430设计的12位心电(ECG)放大器
摘要：本文介绍了心电放大器的基本电路构成，以及采用公司的系列单片机对心电信号进行模数转换处理的方法，还着重探讨了采用带硬件乘法器的系列单片机对心电信号进行滤波处理的方法，并给出了相应的实验结果。人体心肌产生的电信号传导到体表之后，由于在体表分布的不同而产生电位差， ...
教程资料 写给小白们的FPGA入门设计实验
写给小白们的FPGA入门设计实验：
1. 写在前面的话    2
2. Lab 1 ： LCD1602 字符显示设计  3
2.1. 摘要
2.2. 内容
2.3. 程序
2.4. 结果（问题，解决，体会）
3. Lab 2 ： 4 位减法、加法器设计
3.1. 摘要
3.2. 内容
3.3. 程序
...
可编程逻辑 写给小白们的FPGA入门设计实验
写给小白们的FPGA入门设计实验：
1. 写在前面的话    2
2. Lab 1 ： LCD1602 字符显示设计  3
2.1. 摘要
2.2. 内容
2.3. 程序
2.4. 结果（问题，解决，体会）
3. Lab 2 ： 4 位减法、加法器设计
3.1. 摘要
3.2. 内容
3.3. 程序
...
VHDL/FPGA/Verilog 用verlog语言编的一些基础实验,适合于FPGA/CPLD的初学者。内容包括8位优先编码器
用verlog语言编的一些基础实验,适合于FPGA/CPLD的初学者。内容包括8位优先编码器，乘法器，除法器，多路选择器，二进制转BCD码，加法器，减法器等等。
VHDL/FPGA/Verilog 8位risc cpu的编写
8位risc cpu的编写，使用quartus软件对其进行写入，里面内置乘法器、除法器等模块
VHDL/FPGA/Verilog 移位快速除法器
移位快速除法器，通过一次移4位试商实现快速除法功能，较普通减除法器有及其巨大的效率提升
书籍源码 基4-FFT蝶形单元实现
基4-FFT蝶形单元实现，按照FPGA内部的乘法器功能编写的
VHDL/FPGA/Verilog CD4000 双3输入端或非门+单非门 TI CD4001 四2输入端或非门 HIT/NSC/TI/GOL 双4输入端或非门 NSC CD4006 18位串入/串出移位寄存器 NS
CD4000 双3输入端或非门+单非门 TI
CD4001 四2输入端或非门 HIT/NSC/TI/GOL
双4输入端或非门 NSC
CD4006 18位串入/串出移位寄存器 NSC
CD4007 双互补对加反相器 NSC
CD4008 4位超前进位全加器 NSC
CD4009 六反相缓冲/变换器 NSC
CD4010 六同相缓冲/变换器 NSC
CD4011 四2输入端与非门 HIT ...
其他 实现17位加法
实现17位加法，利用一个16位超前进位加法器和一个一位全加器构成的一个有进位输入和进位输出的17加法器，并且16位加法器利用的使四位超前进位加法器构成。它在booth乘法器设计中经常用到。可以使初学者对模块的调用了解更加透彻。 ...
技术资料 AD9854中文资料
·300M内部时钟频率
·可进行频移键控（FSK），二元相移键控（BPSK），相移键控（PSK），脉冲调频（CHIRP），振幅调制（AM）操作
·正交的双通道12位D/A转换器
·超高速比较器，3皮秒有效抖动偏差
·外部动态特性：
80
dB无杂散动态范围（SFDR）@ 100 MHz (±1 MHz) AOUT
·4倍到20倍可编程基准时钟乘 ...