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4位乘法器 的查询结果
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VHDL/FPGA/Verilog 伽罗华域GF（q）乘法器verilog设计.rar
伽罗华域GF（q）乘法器verilog设计.rar
VHDL/FPGA/Verilog 4位微处理器系统的顶层描述代码
4位微处理器系统的顶层描述代码，本人亲自测试，代码很简单。明了。内容无毒。放心下载使用
系统设计方案 51单片机控制4位7段数码管显示
51单片机控制4位7段数码管显示，加计数
C语言编程
VHDL/Verilog/EDA源码 8X8乘法器
自己编写的8x8乘法器，不同的计算部分分别设计。
电子书籍 OTP 4-位带SAR8-位A-D转换器单片机 36页 0.2M.pdf
单片机专辑 258册 4.20GOTP 4-位带SAR8-位A-D转换器单片机 36页 0.2M.pdf
VHDL/Verilog/EDA源码 查找表乘法器
查找表乘法器是将乘积直接放在存储器中，将操作数作为地址访问存储器。
VHDL/Verilog/EDA源码 布斯乘法器
booth算法通过移位运算代替某些加法运算提高乘法器的运算速度，是一种补码乘法的算法。包含乘法器模块和测试模块。
论文 一位加法器
题目：一位加法器的设计
试实现一个十进制的1位数加法器，其中十进制数编码为8421码。十进制数加法可首先转换为二进制加法来执行。然后，若得到的和大于9，则产生一个进位值，并在得到的和值上加6(这是用来补足未使用的六种输入组合)。
要求：（1）利用基本逻辑门电路和编码器，译码器及计数器完成电路；
（2） ...
技术资料 三种高速乘法器的FPGA实现及性能比较讲解
该文档为三种高速乘法器的FPGA实现及性能比较简介资料，讲解的还不错，感兴趣的可以下载看看…………………………
技术资料 基于FPGA的快速阵列乘法器的实现
该文档为基于FPGA的快速阵列乘法器的实现详解资料，讲解的还不错，感兴趣的可以下载看看…………………………