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4位乘法器 的查询结果
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VHDL/FPGA/Verilog 8位加法器的原代码,主要内容下载看了就知道
8位加法器的原代码,主要内容下载看了就知道
VHDL/FPGA/Verilog 实现4位加减乘除的alu
实现4位加减乘除的alu，采用超前进位加法和布斯乘法，代码较为简单。
VHDL/FPGA/Verilog 4bit ALU 利用vhdl语言编写的4位ALU 开发环境是在windows下
4bit ALU 利用vhdl语言编写的4位ALU
开发环境是在windows下
VHDL/FPGA/Verilog 11,13,16位超前进位加法器的Verilog HDL源代码。
11,13,16位超前进位加法器的Verilog HDL源代码。
其他 这个是用vhdl编写的乘法器,仅仅供大家参考
这个是用vhdl编写的乘法器,仅仅供大家参考
其他 veilog实现的状态机乘法器.可以参考
veilog实现的状态机乘法器.可以参考
单片机开发 4位密码检测程序 可以修改所设定的密码 适合在C51单片机上使用
4位密码检测程序
可以修改所设定的密码
适合在C51单片机上使用
VHDL/FPGA/Verilog 布斯乘法器的VHDL程序,下載後直接解壓縮複製貼上到你的EDATOOL就可以.
布斯乘法器的VHDL程序,下載後直接解壓縮複製貼上到你的EDATOOL就可以.
VHDL/FPGA/Verilog 这是用vhdl编写的四位加法器
这是用vhdl编写的四位加法器，请多指教