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单片机编程  4位八段数码管的十进制加计数仿真实验(含电路图和仿真文件)

4位八段数码管的十进制加计数仿真实验，程序采用汇编语言编写。此程序在仿真软件上与EDN-51实验板上均通过。仿真图中的数码管位驱动采用74HC04，如按EDN-51板上用想同的PNP三极管驱动在仿真软件上则无法正常显示。程序共分5块，STAR0为数据初始化，STAR2为计数子程序，STAR3为4位数码管动态显示子程序，STAR4为按键扫描子程 ...

https://www.eeworm.com/dl/502/31577.html

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教程资料  基于FPGA 的单精度浮点数乘法器设计

设计了一个基于FPGA的单精度浮点数乘法器.设计中采用改进的带偏移量的冗余Booth3算法和跳跃式Wallace树型结构,并提出对Wallace树产生的2个伪和采用部分相加的方式,提高了乘法器的运算速度;加入对特殊值的处理模块,完善了乘法器的功能.本设计在Altera DE2开发板上进行了验证. ...

https://www.eeworm.com/dl/fpga/doc/32711.html

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传感与控制  超前进位加法器的设计

超前进位加法器的设计

https://www.eeworm.com/dl/562/34438.html

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可编程逻辑  基于FPGA 的单精度浮点数乘法器设计

设计了一个基于FPGA的单精度浮点数乘法器.设计中采用改进的带偏移量的冗余Booth3算法和跳跃式Wallace树型结构,并提出对Wallace树产生的2个伪和采用部分相加的方式,提高了乘法器的运算速度;加入对特殊值的处理模块,完善了乘法器的功能.本设计在Altera DE2开发板上进行了验证. ...

https://www.eeworm.com/dl/kbcluoji/40361.html

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电子元器件应用  4位共阳LED数码管引脚连接

4位共阳LED数码管引脚连接

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电子书籍  一个并行高速乘法器芯片的设计与实现

一个并行高速乘法器芯片的设计与实现

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VHDL/FPGA/Verilog 门拴电路,4位选择器

门拴电路,4位选择器，alu,用verilog写的。

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数值算法/人工智能  用C语言实现的乘法器

用C语言实现的乘法器

https://www.eeworm.com/dl/518/111587.html

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汇编语言  本程序能从键盘读入二个五位十进制数（1位符号位+4位数值位）

本程序能从键盘读入二个五位十进制数（1位符号位+4位数值位），并将这二个十进制数分别转换为二进制数，然后求其和，再将和以十进制形式进行显示。

https://www.eeworm.com/dl/644/122320.html

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VHDL/FPGA/Verilog 四位除法器的VHDL源程序

四位除法器的VHDL源程序

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