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VHDL/FPGA/Verilog 基于Verilog-HDL的硬件电路的实现 9.5 脉冲周期的测量与显示　　9.5.1 脉冲周期的测量原理　　9.5.2 周期计的工作原理　　9.5.3 周期测量模块的设计与实现

基于Verilog-HDL的硬件电路的实现 9.5 脉冲周期的测量与显示　　9.5.1 脉冲周期的测量原理　　9.5.2 周期计的工作原理　　9.5.3 周期测量模块的设计与实现　　9.5.4 forever循环语句的使用方法　　9.5.5 disable禁止语句的使用方法　　9.5.6 时标信号发生模块的设计与实现　　9.5.7 周期计的Verilog-HDL描述 ...

https://www.eeworm.com/dl/663/197559.html

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VHDL/FPGA/Verilog 基于Verilog-HDL的硬件电路的实现 9.6 脉冲高电平和低电平持续时间的测量与显示　　9.6.1 脉冲高电平和低电平持续时间测量的工作原理　　9.6.2 高低电平持续时间测量模

基于Verilog-HDL的硬件电路的实现 9.6 脉冲高电平和低电平持续时间的测量与显示　　9.6.1 脉冲高电平和低电平持续时间测量的工作原理　　9.6.2 高低电平持续时间测量模块的设计与实现　　9.6.3 改进型高低电平持续时间测量模块的设计与实现　　9.6.4 begin声明语句的使用方法　　9.6.5 initial语句和always语句 ...

https://www.eeworm.com/dl/663/197560.html

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嵌入式Linux Driver for USB Scanners (linux-2.6）

Driver for USB Scanners (linux-2.6）

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DSP编程  用于开发TI的TMS320F2812FSP的学习用开发环境为CCS2.2

用于开发TI的TMS320F2812FSP的学习用开发环境为CCS2.2

https://www.eeworm.com/dl/516/198022.html

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通讯/手机编程  This version 0.2 of driver for a simple CAN bus interface．一个CAN 总线接口程序

This version 0.2 of driver for a simple CAN bus interface．一个CAN 总线接口程序，供大家分享！

https://www.eeworm.com/dl/527/198138.html

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人工智能/神经网络  数据挖掘中的基于关联规则的分类算法源码2

数据挖掘中的基于关联规则的分类算法源码2

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汇编语言  data array sdword 2 dup(?) str1 byte "Please input one 32-bit sign number :",0dh,0ah,0 str2 by

data array sdword 2 dup(?) str1 byte "Please input one 32-bit sign number :",0dh,0ah,0 str2 byte "The result is : ",0 align 4 jia1gao sdword 0 jia1 sdword 0 .code main proc call clrscr mov esi,offset array mov ecx,lengthof array mov edx,offset str1 push esi putin: call writestring ...

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嵌入式Linux hfrk的2.6.14内核 arm

hfrk的2.6.14内核 arm

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微处理器开发  利用 ADS1.2 开发的s3c2410平台下的汉字显示程序

利用 ADS1.2 开发的s3c2410平台下的汉字显示程序

https://www.eeworm.com/dl/655/200056.html

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其他  2.5 英寸硬盘接口定义

2.5 英寸硬盘接口定义，方便ide用户ide接口设计。

https://www.eeworm.com/dl/534/200166.html

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