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Delphi控件源码  WindPE for Borland Delphi 7.0: {*******************************************************} { } { Wi

WindPE for Borland Delphi 7.0: {*******************************************************} { } { WindPE for Borland Delphi 7.0 } { } { Code:WindRand http://www.pefine.com } { } { Copyright (c) 2007 Pefine Security Lab } {*******************************************************}

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数据结构  校园导游咨询：编制一个为来访客人进行最短路径导游的程序从厦门大学漳州校区的平面图中选取10个有代表性的景点

校园导游咨询：编制一个为来访客人进行最短路径导游的程序从厦门大学漳州校区的平面图中选取10个有代表性的景点，抽象成一个无向带权图。以图中顶点表示景点，边上的权值表示两地之间的距离。 2.本程序的目的是为用户提供路径咨询。根据用户指定的始点和终点输出相应路径，或者根据用户指定的景点输出景点的信息。 ...

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其他书籍  Sams Teach Yourself Regular Expressions in 10 Minutes By Ben Forta Publisher : Sams Publishin

Sams Teach Yourself Regular Expressions in 10 Minutes By Ben Forta Publisher : Sams Publishing Pub Date : February 28, 2004 ISBN : 0-672-32566-7 Pages : 192

https://www.eeworm.com/dl/542/293419.html

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VHDL/FPGA/Verilog Verilog语言实现的Hamming(3,7)编码器

Verilog语言实现的Hamming(3,7)编码器，可用于FPGA实现

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单片机开发  K3:--- P1.6 K4:--- P1.7 BEEP:--- P3.7 K3 --- 控制按键 K4 --- 清零按键开机显示： SECOND-CLOCK 0 TIM

K3:--- P1.6 K4:--- P1.7 BEEP:--- P3.7 K3 --- 控制按键 K4 --- 清零按键开机显示： SECOND-CLOCK 0 TIME 00:00:00:00 K3 --- 控制按键：第一次按下时,开始计时。显示 BEGIN COUNT 1 TIME 00:00:01:88 第二次按下时,暂停计时。显示 PAUST COUNT 2 TIME 00:00:01:88 第三次按下时,累计计时。 ...

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VHDL/FPGA/Verilog VerilogHDL硬件描述语言之10

VerilogHDL硬件描述语言之10

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数据结构  实现线性表的顺序存储表示及基于顺序存储表示实现线性表的初始化、查找、插入与删除等基本操作。具体实现要求：1．从键盘输入10个整数

实现线性表的顺序存储表示及基于顺序存储表示实现线性表的初始化、查找、插入与删除等基本操作。具体实现要求：1．从键盘输入10个整数，产生顺序表，并输入结点值。2．从键盘输入1个整数，在顺序表中查找该结点的位置。若找到，输出结点的位置；若找不到，则显示“找不到”。3．从键盘输入2个整数，一个表示欲插入的位置i， ...

https://www.eeworm.com/dl/654/294998.html

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其他书籍  S60-programming-a-tutorial-guide-symbian. 1 Introduction to Mobile-Phone Systems 1 1.1 Wireless

S60-programming-a-tutorial-guide-symbian. 1 Introduction to Mobile-Phone Systems 1 1.1 Wireless Technologies 1 1.2 Cellular Systems 2 1.3 Elements of a Mobile-Phone System 4 1.4 Keeping Users’ Calls Separate 5 1.5 Multipath Propagation 7 1.6 2G Mobile-Phone Systems 9 1.7 GPRS Systems 10 1.8 3G Mob ...

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系统设计方案  运放稳定性第一部分一共上传10部分环路稳定性基础

运放稳定性第一部分一共上传10部分环路稳定性基础

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系统设计方案  ti公司的运算放大器的稳定性第二部分一共上传10部分运放网络 spice分析

ti公司的运算放大器的稳定性第二部分一共上传10部分运放网络 spice分析

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