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教程资料  基于FPGA 的低成本长距离高速传输系统的设计与实现

为解决目前高速信号处理中的数据传输速度瓶颈以及传输距离的问题，设计并实现了一种基于FPGA 的高速数据传输系统，本系统借助Altera Cyclone III FPGA 的LVDS I/O 通道产生LVDS 信号，稳定地完成了数据的高速、远距离传输。系统所需的8B/10B 编解码、数据时钟恢复(CDR)、串/并行转换电路、误码率计算模块均在FPGA 内利用VHD ...

https://www.eeworm.com/dl/fpga/doc/32681.html

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教程资料  数字成形滤波器设计及FPGA实现

本文对数字基带信号脉冲成型滤波的应用、原理及实现进行了研究。首先介绍了数字成型滤波的应用意义并分析了模拟和数字两种硬件实现方法，接着介绍了成形滤波器设计所需要MATLAB软件，以及利用ISE system generator在FPGA上进行滤波器实现的优势。文中给出了成形滤波函数的数学模型，讨论了几种常用成形滤波函数的传输特性以 ...

https://www.eeworm.com/dl/fpga/doc/32687.html

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教程资料  基于FPGA的高速串行传输接口研究与实现

摘　要:介绍了FPGA最新一代器件Virtex25上的高速串行收发器RocketIO。基于ML505开发平台构建了一个高速串行数据传输系统,重点说明了该系统采用RocketIO实现1. 25Gbp s高速串行传输的设计方案。实现并验证了采用FPGA完成千兆串行传输的功能目标,为后续采用FPGA实现各种高速协议奠定了良好的基础。关键词: FPGA;高速串行传输; ...

https://www.eeworm.com/dl/fpga/doc/32706.html

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教程资料  基于FPGA的多路高速串并转换器设计

高速串并转换器的设计是FPGA 设计的一个重要方面,传统设计方法由于采用FPGA 的内部逻辑资源来实现,从而限制了串并转换的速度。该研究以网络交换调度系统的FGPA 验证平台中多路高速串并转换器的设计为例,详细阐述了1 :8DDR 模式下高速串并转换器的设计方法和16 路1 :8 串并转换器的实现。结果表明,采用Xilinx Virtex24 的ISE ...

https://www.eeworm.com/dl/fpga/doc/32712.html

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教程资料  基于FPGA的全数字锁相环路的设计

介绍了应用VHDL技术设计嵌入式全数字锁相环路的方法。详细描述了其工作原理和设计思想，并用可编程逻辑器件FPGA加以实面。

https://www.eeworm.com/dl/fpga/doc/32715.html

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教程资料  基于CPLD器件的现代数字系统设计方法

摘要：介绍了一种利用CPLD芯片设计的数字钟电路，该系统采用自顶向下的层次模块化设计手段构建电路，代表了BDA的发展趋势。文中结合实例详尽介绍了原理图设计输入方式以及设计过程。    

https://www.eeworm.com/dl/fpga/doc/32722.html

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通信网络  毫米波低相噪捷变频高分辨率雷达频率源设计

设计了一种由直接数字频率合成(DDS)、倍频链构成的三次变频直接频率合成方案，实现了低相噪捷变频高分辨率毫米波雷达频率合成器设计。利用直接频率合成器的倍频输出取代传统三次变频毫米波频率源的锁相环(PLL),同时提供线性调频(LFM)信号，优化DDS和变频方案的频率配置关系。利用FPGA电路进行高速控制，较好地解决了毫米波 ...

https://www.eeworm.com/dl/564/32735.html

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通信网络  基于SCT3918的CDMR数字对讲机设计

为了响应国家工业和信心产业部[2009]666号文件我国数字对讲机实现模拟转数字化的要求，并且为了方便企业生产和调试、降低成本的目的。采用国产基带芯片SCT3918设计了一款适应我国国情的数字对讲机CDMR（China Digital Mobile Radio），在实验室内做了射频技术指标测试、音频技术指标测试、可靠性测试，实验结果表明射频技术 ...

https://www.eeworm.com/dl/564/32831.html

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通信网络  声纳信号发生器通信控制模块的设计

文中针对某型声纳维修训练系统的通信需求，结合声纳信号发生器的特点，提出了基于C/S模式的通信控制模块设计方案。模块采用Winsock网络编程技术实现了客户机与服务器间高速局域网通信，服务器响应客户机的请求后，输出数字控制量并利用PCI-1711的12位D/A转换功能，将数字控制量转换为模拟信号，从而实现声纳信号发生器任意 ...

https://www.eeworm.com/dl/564/33202.html

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通信网络  一种点对点高速通信控制器的设计与实现

为了提高CPU模块之间的点对点通信速率，通过对以太网控制器MAC的研究，设计出一种点对点高速通信控制器。该控制器是基于媒体无关接口MII和以太网收发器的点对点高速通信控制器。利用VHDL语言编写该控制器的相关代码，使用MAXPLUSⅡ对该控制器的数据发送和数据接收进行仿真，并在实验室样机上进行实现。仿真结果和实验结果表 ...

https://www.eeworm.com/dl/564/33289.html

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