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可编程逻辑 小型化设计的实现与应用
电子产品功能越来越强大的同时，对便携的要求也越来越高，小型化设计成为很多电子设计公司的研究课题。本文以小型化设计的方法、挑战和趋势为主线，结合Cadence SPB16.5在小型化设计方面的强大功能，全面剖析小型化设计的工程实现。主要包括以下内容：小型化设计的现状和趋势，以及现在主流的HDI加工工艺，介绍最新的ANYLAY ...
可编程逻辑 高速电路传输线效应分析与处理
随着系统设计复杂性和集成度的大规模提高，电子系统设计师们正在从事100MHZ以上的电路设计，总线的工作频率也已经达到或者超过50MHZ，有一大部分甚至超过100MHZ。目前约80% 的设计的时钟频率超过50MHz，将近50% 以上的设计主频超过120MHz，有20%甚至超过500M。当系统工作在50MHz时，将产生传输线效应和信号的完整性问题；而 ...
可编程逻辑 高性能PCB设计的工程实现
一、PCB设计团队的组建建议 二、高性能PCB设计的硬件必备基础三、高性能PCB设计面临的挑战和工程实现 1.研发周期的挑战 2.成本的挑战 3.高速的挑战 4.高密的挑战 5.电源、地噪声的挑战 6.EMC的挑战 7.DFM的挑战四、工欲善其事，必先利其器摘要：本文以IT行业的高性能的PCB设计为主线，结合Cadence在高速PCB设计方面的强大功 ...
可编程逻辑 基于FPGA的高速电路设计与仿真
现代数字信号处理从视频扩展到了中频甚至射频,针对要求信号处理的处理速度越来越高、传输速率越来越快等特点,给出了一款使用高性能FPGA、DAC以及经先进的PCB设计工具设计、仿真的高速信号处理模块,实现了对高速信号的实时接收和处理。关键词:数字信号处理; 高速电路; FPGA;设计与仿真 ...
可编程逻辑 基于FPGA的多路高速串并转换器设计
高速串并转换器的设计是FPGA 设计的一个重要方面,传统设计方法由于采用FPGA 的内部逻辑资源来实现,从而限制了串并转换的速度。该研究以网络交换调度系统的FGPA 验证平台中多路高速串并转换器的设计为例,详细阐述了1 :8DDR 模式下高速串并转换器的设计方法和16 路1 :8 串并转换器的实现。结果表明,采用Xilinx Virtex24 的ISE ...
可编程逻辑 通用阵列逻辑GAL实现基本门电路的设计
通用阵列逻辑GAL实现基本门电路的设计
一、实验目的
1.了解GAL22V10的结构及其应用；
2.掌握GAL器件的设计原则和一般格式；
3.学会使用VHDL语言进行可编程逻辑器件的逻辑设计；
4.掌握通用阵列逻辑GAL的编程、下载、验证功能的全部过程。
二、实验原理
1. 通用阵列逻辑GAL22V10
通用阵列逻辑GAL是由可编程的与阵列、固定（ ...
可编程逻辑 高速PCB设计指南
高速PCB设计指南之（一~八 ）目录      2001/11/21  一、1、PCB布线2、PCB布局3、高速PCB设计
二、1、高密度（HD）电路设计2、抗干扰技术3、PCB的可靠性设计4、电磁兼容性和PCB设计约束
三、1、改进电路设计规程提高可测性2、混合信号PCB的分区设计3、蛇形走线的作用4、确保信号完整性的电路 ...
工控技术 高速信号采集存储及光纤传输系统的设计与实现
高速信号采集存储与光纤传输系统
测试测量 基于USB2.0与LabVIEW的高速数据采集系统设计
计算机对信号进行分析和处理依赖于数据的采集，而现有的数据采集卡成本高，接口复杂，不易扩展。采用USB控制器和FPGA为核心设计系统的硬件平台，再结合LabVIEW设计用户应用程序、NI-VISA开发USB驱动程序，最终实现高速数据采集系统的设计。实验结果表明，系统集成度高，结构灵活便于扩展，达到了30Mbit/s的可靠数据传输速度 ...
测试测量 JPEG2000中二维小波变换的高速VLSI设计与实现
提出了一种基于9/7小波的二维小波变换器的硬件设计方案.通过优化算法以及采用行列变换并行处理的方式,提高了变换器的数据吞吐量.该方案采用了流水线技术,较大地提高了硬件效率.综合结果表明,该方案的系统时钟可达到110 MHz,且具有高速、高吞吐量、片内存储器小等优点. ...