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系统设计方案 高效优质声码器算法

高效优质声码器算法,论文中步骤很详细。值得参考
https://www.eeworm.com/dl/678/360014.html
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人工智能/神经网络 一个用VC实现的高效bp神经网络算法源代码

一个用VC实现的高效bp神经网络算法源代码,希望对大家有帮助.
https://www.eeworm.com/dl/650/361559.html
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其他 1.本文对一种高效的升压式PWM 变换电路作了分析研究 对开关状态的切换效率高 采用双零软开关工作

1.本文对一种高效的升压式PWM 变换电路作了分析研究 对开关状态的切换效率高 采用双零软开关工作,大大降低了开关损耗, 提 高了电路的转换效率. 2.该电路在高频的开关电源、逆变器等电力电子电路上有很大的实用价值, 可以提高电路的转换效率. ...
https://www.eeworm.com/dl/534/361783.html
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VC书籍 指导怎样进行高效高质量的C++程序开发

指导怎样进行高效高质量的C++程序开发,文章简明,适用于基础开发。
https://www.eeworm.com/dl/686/364286.html
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matlab例程 高效的图像旋转程序

高效的图像旋转程序,Matlab语言编写,易读。
https://www.eeworm.com/dl/665/365402.html
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VHDL/FPGA/Verilog RISC状态机由三个功能单元构成:处理器、控制器和存储器。 RISC状态机经优化可实现高效的流水线操作。 RISC 中的数据线为16位。 在数据存储器中的0到15的位置放置16个随机数

RISC状态机由三个功能单元构成:处理器、控制器和存储器。 RISC状态机经优化可实现高效的流水线操作。 RISC 中的数据线为16位。 在数据存储器中的0到15的位置放置16个随机数,求16个数的和,放在数据存储器的16、17的位置,高位在前 对这16个数进行排序,从大到小放置在18到33的位置 求出前16个数的平均数,放在34的位置 ...
https://www.eeworm.com/dl/663/366291.html
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VHDL/FPGA/Verilog 程序提供了一种高效简单的38译码器的算法

程序提供了一种高效简单的38译码器的算法,非常实用
https://www.eeworm.com/dl/663/366350.html
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VHDL/FPGA/Verilog 程序提供了一种简单高效的并入串出寄存器的算法

程序提供了一种简单高效的并入串出寄存器的算法,非常实用
https://www.eeworm.com/dl/663/366351.html
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VHDL/FPGA/Verilog 程序提供了一种简单高效的模拟交通灯控制器的算法

程序提供了一种简单高效的模拟交通灯控制器的算法,非常实用
https://www.eeworm.com/dl/663/366352.html
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uCOS uC/OS2系统下的高效队列源码

uC/OS2系统下的高效队列源码,稳定可靠,并优化了运行效率,支持批量插入和读取。开发环境:ads1.2
https://www.eeworm.com/dl/649/370550.html
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