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汇编语言  信号发生器的汇编源程序实现输出的

信号发生器的汇编源程序实现输出的，正弦波，三角波，方波

https://www.eeworm.com/dl/644/316771.html

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汇编语言  全部都是正弦波发生器的汇编源程序的

全部都是正弦波发生器的汇编源程序的，主要利用DAC0832

https://www.eeworm.com/dl/644/316772.html

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汇编语言  波特率发生器

波特率发生器，一段基于FPGA的源代码，经测试和调试可以使用，所以上载分享。

https://www.eeworm.com/dl/644/316949.html

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单片机开发  有关与信号发生器的程序,用到单片机编程设计,输出信号可靠.

有关与信号发生器的程序,用到单片机编程设计,输出信号可靠.

https://www.eeworm.com/dl/648/317535.html

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单片机开发  用0832做的一个波形发生器

用0832做的一个波形发生器，具有proteus仿真图

https://www.eeworm.com/dl/648/318015.html

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VHDL/FPGA/Verilog 基于FPGA的VGA显示器彩条发生器是必备的VGA原码控制

基于FPGA的VGA显示器彩条发生器是必备的VGA原码控制

https://www.eeworm.com/dl/663/318530.html

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VHDL/FPGA/Verilog 电子琴VHDL程序包含有：顶层程序、音阶发生器程序、数控分频模块程序和自动演奏模块程序

电子琴VHDL程序包含有：顶层程序、音阶发生器程序、数控分频模块程序和自动演奏模块程序

https://www.eeworm.com/dl/663/318639.html

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加密解密  利用ANSI X9.17标准模拟了一个伪随机数发生器

利用ANSI X9.17标准模拟了一个伪随机数发生器，内核加密算法调用3DES算法，能够按照标准要求产生64位伪随机数和64位种子值。

https://www.eeworm.com/dl/519/320597.html

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VHDL/FPGA/Verilog EDA实验--UART串口实验：UART 主要有由数据总线接口、控制逻辑、波特率发生器、发送部分和接收部分等组成。UART 发送器 --- 发送器每隔16 个CLK16 时钟周期输出1 位

EDA实验--UART串口实验：UART 主要有由数据总线接口、控制逻辑、波特率发生器、发送部分和接收部分等组成。UART 发送器 --- 发送器每隔16 个CLK16 时钟周期输出1 位，次序遵循1位起始位、8位数据位（假定数据位为8位）、1位校验位（可选）、1位停止位。 UART 接收器 --- 串行数据帧和接收时钟是异步的，发送来的数据由逻 ...

https://www.eeworm.com/dl/663/320690.html

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软件设计/软件工程  信号源发生器的实用程序,适用键盘,显示

信号源发生器的实用程序,适用键盘,显示

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