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VHDL/FPGA/Verilog 【经典设计】VHDL源代码下载～～ 其中经典的设计有：【自动售货机】、【电子钟】、【红绿灯交通信号系统】、【步进电机定位控制系统】、【直流电机速度控制系统】、【计算器】、【点阵列LED显示控制系统】
【经典设计】VHDL源代码下载～～
其中经典的设计有：【自动售货机】、【电子钟】、【红绿灯交通信号系统】、【步进电机定位控制系统】、【直流电机速度控制系统】、【计算器】、【点阵列LED显示控制系统】
基本数字逻辑设计有：【锁存器】、【多路选择器】、【三态门】、【双向输入|输出端口】、【内部（缓冲）信号】、【编 ...
VHDL/FPGA/Verilog 朋友
朋友，我是Jawen.看到先前上载的一套CPLD开发板的VHDL源码挺受欢迎的，现在就将她的Verilog源码也一并贡献给大家：8位优先编码器,乘法器,多路选择器,二进制转BCD码,加法器,减法器,简单状态机,四位比较器,7段数码管,i2c总线,lcd液晶显示,拨码开关,串口,蜂鸣器,矩阵键盘,跑马灯,交通灯,数字时钟 ...
书籍源码 100个经典vhdl编程实例
100个经典vhdl编程实例，
第1例 带控制端口的加法器
第2例 无控制端口的加法器
第3例 乘法器
第4例 比较器
第5例 二路选择器
第6例 寄存器
第7例 移位寄存器
第8例 综合单元库
第9例 七值逻辑与基本数据类型
第10例 函数
第11例 七值逻辑线或分辨函数
第12例 转换函数
第13例 左移函数
第14例 七值逻辑程序包
第15例 四输入 ...
并行计算 数字系统设计这是有关的相关源代码
数字系统设计这是有关的相关源代码，有简易CPU 除法器、计数器等 ...[fpdiv_vhdl.rar] - 四位除法器的vhdl源程序 [vhdl范例.rar] - 最高优先级编码器8位相等比较器 三人表决器（三种不同的描述方式） 加法器描述 8位总线收发器：74245 （注2） 地址译码（for m68008） 多路选择器（使 BR> ... ...
软件设计/软件工程 10个VHDL程序实例
10个VHDL程序实例，包括加法器，全加器、函数发生器，选择器等。
Java编程 Ajax 第一部分 重新思考Web应用 第1章 一种新的Web设计方法 1.1 为什么需要Ajax富客户端？ 1.1.1 比较用户体验 1.1.2 网络延迟 1.1.3 异步交互
Ajax
第一部分 重新思考Web应用
第1章 一种新的Web设计方法
1.1 为什么需要Ajax富客户端？
1.1.1 比较用户体验
1.1.2 网络延迟
1.1.3 异步交互
1.1.4 独占或瞬态的使用模式
1.1.5 忘掉Web
1.2 Ajax的四个基本原则
1.2.1 浏览器中的是应用而不是内容
1.2.2 服务器交付的是数据而不是内容
1.2.3 用户交互变得流畅 ...
Delphi控件源码 关于verilog的各个基本模块的源代码
关于verilog的各个基本模块的源代码，如加法器，寄存器，选择器及各个测试文件
VHDL/FPGA/Verilog 很多实用的例程
很多实用的例程，包括触发器，译码器，多路选择器
Ajax jQuery1.2中文片API详细说明
jQuery1.2中文片API详细说明，chm格式
包括的内容：核心、选择器、属性、筛选、文档处理、CSS、事件、效果、AJAX、工具等。