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VHDL/FPGA/Verilog 数字频率计是一种用来测试周期性变化信号工作频率的装置。其原理是在规定的单位时间（闸门时间）内

数字频率计是一种用来测试周期性变化信号工作频率的装置。其原理是在规定的单位时间（闸门时间）内，记录输入的脉冲的个数。我们可以通过改变记录脉冲的闸门时间来切换测频量程。本文利用EDA技术中的Max+plusⅡ作为开发工具,设计了基于FPGA的8位十进制频率计,并下载到在系统可编程实验板的EPF10K20TC144-4器件中测试实现了 ...

https://www.eeworm.com/dl/663/444247.html

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单片机开发  基于单片机的数字频率计设计

基于单片机的数字频率计设计，定时器T0完成定时功能，T1采用计数功能

https://www.eeworm.com/dl/648/446222.html

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汇编语言  等精度频率计利用51单片机实现有源码以及执行文件

等精度频率计利用51单片机实现有源码以及执行文件

https://www.eeworm.com/dl/644/447005.html

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其他  硬件C程序很有用用于频率计设计！

硬件C程序很有用用于频率计设计！

https://www.eeworm.com/dl/534/448225.html

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VHDL/FPGA/Verilog 8位十进制数字频率计测量频率范围在1HZ—1MHZ之间

8位十进制数字频率计测量频率范围在1HZ—1MHZ之间

https://www.eeworm.com/dl/663/448543.html

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嵌入式/单片机编程  本程序完整的实现了数字频率计的常用功能。并对通常数字频率计的常见问题进行了改进。具有实用价值。

本程序完整的实现了数字频率计的常用功能。并对通常数字频率计的常见问题进行了改进。具有实用价值。

https://www.eeworm.com/dl/647/448916.html

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单片机开发  我自己刚刚做的一个频率计

我自己刚刚做的一个频率计，不是很会！希望大家给我提意见

https://www.eeworm.com/dl/648/450765.html

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文章/文档  本文描述的是数字式频率计的设计过程

本文描述的是数字式频率计的设计过程，其中包含了所用到的VHDl语言的源代码，和仿真图型，是比较完整描述的设计数字频率计的文章

https://www.eeworm.com/dl/652/451023.html

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VHDL/FPGA/Verilog 频率计VHDL编程。设计一个4位数字显示的十进制频率计

频率计VHDL编程。设计一个4位数字显示的十进制频率计，其测量范围为1MHz，测量值通过4个数码管显示以8421BCD码形式输出，可通过开关实现量程控制，量程分10kHz、100kHz、1MHz三档(最大读数分别为9.999kHz、99.99kHz、999.9kHz)；当输入信号的频率大于相应量程时，有溢出显示。 ...

https://www.eeworm.com/dl/663/451171.html

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单片机开发  频率计的设计,单片机初学者必须程序,适用于proteus

频率计的设计,单片机初学者必须程序,适用于proteus

https://www.eeworm.com/dl/648/451469.html

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