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VHDL/FPGA/Verilog 自己做的FPGA下的频率计模块化设计附有完整的程序和仿真图纸

自己做的FPGA下的频率计模块化设计附有完整的程序和仿真图纸

https://www.eeworm.com/dl/663/314917.html

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单片机开发  四位频率计

四位频率计，实现10～100kHz的频率测量，采用测周法

https://www.eeworm.com/dl/648/315933.html

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VHDL/FPGA/Verilog 这是我课程设计做的数字频率计的设计

这是我课程设计做的数字频率计的设计，不知道会不会太简单或者重复了。

https://www.eeworm.com/dl/663/317181.html

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单片机开发  基于51单片机设计的用1602 显示数字钟频率计歌曲

基于51单片机设计的用1602 显示数字钟频率计歌曲

https://www.eeworm.com/dl/648/318111.html

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其他  该程序实现一个频率计

该程序实现一个频率计，测量范围：1-49999999赫兹，用8为数码管扫描显示出被测信号的频率。 INT_DIV模块用于对系统的频率进行分频，此模块的输出信号为被测信号的频率，可以自己设定分频系数，验证频率计的功能，实际应用中，可去掉此模块，直接把待测信号加到CLKCIN端即可。 MYPINLVJI模块是实现频率计的主程序，对系统时 ...

https://www.eeworm.com/dl/534/318799.html

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VHDL/FPGA/Verilog 简单的数字频率计

简单的数字频率计，source为输入，可以测量其频率，在maxplux中使用，需要标准的1hz时钟信号。

https://www.eeworm.com/dl/663/320665.html

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单片机开发  用51单片机做的简单频率计,KEIL C环境,带工程文件,可直接编译运行.主要演示如何在内存很少,无法启用RTOS的单片机(例如2051)中使用状态机和时间片来完成实时多任务并行处理.例子中对键盘,信

用51单片机做的简单频率计,KEIL C环境,带工程文件,可直接编译运行.主要演示如何在内存很少,无法启用RTOS的单片机(例如2051)中使用状态机和时间片来完成实时多任务并行处理.例子中对键盘,信号采集和LED数码管的显示三部分进行了并行处理,而采用的单片机是仅有256字节内存2K ROM的89C2051. ...

https://www.eeworm.com/dl/648/322517.html

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单片机开发  6位数码管显示的数字频率计

6位数码管显示的数字频率计，测量范围可达65KMz，测量误差小。

https://www.eeworm.com/dl/648/322566.html

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嵌入式/单片机编程  单片机程序 51频率计电子琴电子钟程序按键显示程序最终成功

单片机程序 51频率计电子琴电子钟程序按键显示程序最终成功

https://www.eeworm.com/dl/647/323960.html

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VHDL/FPGA/Verilog 基于FPGA设计的数字频率计

基于FPGA设计的数字频率计，用VHDL写的代码。。。。有6各模块

https://www.eeworm.com/dl/663/324086.html

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