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频率计算器 的查询结果
教程资料 等精度频率测量原理
主要介绍了等精度频率测量原理，该原理具有在整个测试频段内保持高精度频率\r\n测量的优点 同时在该原理基础上，采用了Verilog HDL语言设计了高速的等精度测频\r\n模块，并且利用EDA开发平台QUARTUS11 3 .0对CPLD芯片进行写人，实现了计数等\r\n主要逻辑功能 还使用C语言设计了该等精度频率计的主控程序以提高测量精度。本 ...
教程资料 keil和Proteus设计的C51频率计代码
一个自己用keil和Proteus设计的C51频率计代码,与大家一同分享!
教程资料 基于等精度测量原理的频率计
基于等精度测量原理的频率计，AT89S52和CPLD,有详细注释。测量准确。
教程资料 FPGA下的频率计模块化设计 附有完整的程序和仿真图纸
自己做的FPGA下的频率计模块化设计 附有完整的程序和仿真图纸
教程资料 FPGA实现频率合成的技术，含软硬件设计
尽管频率合成技术已经经历了大半个世纪的发展史，但直到今天，人们对\\r\\n它的研究仍然在继续。现在，我们可以开发出输出频率高达IG的DDS系统，\\r\\n武汉理工大学硕士学位论文\\r\\n已能满足绝大多数频率源的要求，集成DDS产品的信噪比也可达到75dB以上，\\r\\n已达到锁相频率合成的一般水平。电子技术的发展己进入数字时 ...
教程资料 基于FPGA的直接数字频率合成器的设计与实现
基于FPGA的直接数字频率合成器的设计与实现.
教程资料 高频感应加热电源中用传统的模拟锁相环跟踪频率所存在的问题
针对高频感应加热电源中用传统的模拟锁相环跟踪频率所存在的问题,提出一种非常适合于高频感应加热的\r\n新型的数字锁相环。使用FPGA 内底层嵌入功能单元中的数字锁相环74HCT297 ,并添加少量的数字电路来实现。最后利\r\n用仿真波形验证该设计的合理性和有效性。整个设计负载范围宽、锁相时间短,现已成功应用于100 kHz/ 30 k ...
教程资料 直接数字频率合成（Direct Digital Fraquency Synthesis,即DDFS
直接数字频率合成（Direct Digital Fraquency Synthesis,即DDFS，一般简称DDS）是从相位概念出发直接合成所需要波形的一种新的频率合成技术。
教程资料 使用VHDL编写的频率的精确测量方法的代码
文档中给出了使用VHDL编写的频率的精确测量方法的代码,同时还有cPLD与e2rom等的接口代码