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频率计数器 的查询结果
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其他 设计功能及要求 设计M=99的十进制加/减可逆计数器 （1）接通电源时电路能自启动； （2）手动分别实现加、减计数和自动实现加减可逆计数； （3）用数码管显示计数数值。 (4）给定元
设计功能及要求
设计M=99的十进制加/减可逆计数器
（1）接通电源时电路能自启动；
（2）手动分别实现加、减计数和自动实现加减可逆计数；
（3）用数码管显示计数数值。
(4）给定元件：74LS192、74LS00、74LS76、74LS48及LED。 ...
单片机开发 舵机的驱动程序,用ATMEGA16编写的,使用定时中断模拟PWM输出20Hz频率,占空比可调.
舵机的驱动程序,用ATMEGA16编写的,使用定时中断模拟PWM输出20Hz频率,占空比可调.
VHDL/FPGA/Verilog 这是一个键盘防抖动的C程序。该防抖动程序采用计数器型
这是一个键盘防抖动的C程序。该防抖动程序采用计数器型，简单，稳定，省资源。
VHDL/FPGA/Verilog CPLD_EPM7064程序,运用计数器实现的分频程序,VHDL
CPLD_EPM7064程序,运用计数器实现的分频程序,VHDL
嵌入式/单片机编程 gray码计数器 用于减少出错率 代码已经仿真 请放心下载
gray码计数器 用于减少出错率 代码已经仿真 请放心下载
并行计算 程序计算了国产矩形波导BJ-100的传输特性。通过查阅资料可以知道BJ-100波导管的结构参数为频率范围（8.2GHz~12.5GHz）结构参数a=22.86mm,b=10.16mm FDTD计算
程序计算了国产矩形波导BJ-100的传输特性。通过查阅资料可以知道BJ-100波导管的结构参数为频率范围（8.2GHz~12.5GHz）结构参数a=22.86mm,b=10.16mm
FDTD计算 fortran 语言
文件格式 直接数字频率合成（Direct Digital Fraquency Synthesis,即DDFS
直接数字频率合成（Direct Digital Fraquency Synthesis,即DDFS，一般简称DDS）是从相位概念出发直接合成所需要波形的一种新的频率合成技术。
单片机开发 单片机PWM控制产生不同频率的波形来控制蜂鸣器
单片机PWM控制产生不同频率的波形来控制蜂鸣器
VHDL/FPGA/Verilog 加减计数器
加减计数器，其实也没什么，想要就拿去了，给我拿别人的东西才重要