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教程资料 使用VHDL编写的频率的精确测量方法的代码
文档中给出了使用VHDL编写的频率的精确测量方法的代码,同时还有cPLD与e2rom等的接口代码
教程资料 用单片机AT89s52和epm7128设计的频率计
用单片机AT89s52和epm7128设计的频率计
教程资料 数控振荡器的频率控制字寄存器、相位控制字寄存器、累加器和加法器可以用VHDL语言描述
数控振荡器的频率控制字寄存器、相位控制字寄存器、累加器和加法器可以用VHDL语言描述，集成在一个模块中，提供VHDL源程序供大家学习和讨论。\r\n
教程资料 JTAG CPLD实现源代码
JTAG CPLD实现源代码，比用简单并口调试器快5倍以上。\r\n以前总觉得简单的并口jtag板速度太慢，特别是调试bootloader的时候，简直难以忍受。最近没什么事情，于是补习了几天vhdl，用cpld实现了一个快速的jtag转换板。cpld用epm7128stc100-15，晶振20兆，tck频率5兆。用sjf2410作测试，以前写50k的文件用时5分钟，现在则是5 ...
教程资料 在EDA中基于数字频率合成器的FPGA实现
在EDA中，基于数字频率合成器的FPGA实现
教程资料 基于ARM平台的等精度数字显示频率计的设计
基于ARM平台的等精度数字显示频率计的设计,已通过测试
教程资料 FPGA和PC机之间串行通信对输出正弦波频率的控制
1、 利用FLEX10的片内RAM资源，根据DDS原理，设计产生正弦信号的各功能模块和顶层原理图； 2、 利用实验板上的TLC7259转换器，将1中得到的正弦信号，通过D/A转换，通过ME5534滤波后在示波器上观察； 3、 输出波形要求： 在输入时钟频率为16KHz时，输出正弦波分辨率达到1Hz； 在输入时钟频率为4MHz时，输出正弦波分辨率达到2 ...
教程资料 用vhdl编写的基于fpga的数字频率计程序算法
用vhdl编写的基于fpga的数字频率计程序算法
教程资料 液晶显示例子,晶振频率Fosc=8MHz,内有仿真文件
液晶显示例子,晶振频率Fosc=8MHz,内有仿真文件
模拟电子 4046锁相环功率超声电源的频率跟踪电路
4046锁相环功率超声电源的频率跟踪电路 值得参考